MPC850 PowerQUICC Integrated Communications Processor Hardware Specifications, Rev. 2
Freescale Semiconductor
19
Bus Signal Timing
Figure 2 is the control timing diagram.
Figure 2. Control Timing
Figure 3 provides the timing for the external clock.
Figure 3. External Clock Timing
CLKOUT
Outputs
A
B
2.0 V
0.8 V
2.0 V
0.8 V
2.0 V
0.8 V
Outputs
2.0 V
0.8 V
2.0 V
0.8 V
B
A
Inputs
2.0 V
0.8 V
2.0 V
0.8 V
D
C
Inputs
2.0 V
0.8 V
2.0 V
0.8 V
C
D
A
Maximum output delay specification
B
Minimum output hold time
C
Minimum input setup time specification
D
Minimum input hold time specification
CLKOUT
B1
B5
B3
B4
B1
B2
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PDF描述
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