參數(shù)資料
型號： MPC563MZP66R2
廠商： Freescale Semiconductor
文件頁數(shù)： 443/1420頁
文件大?。?/td> 0K
描述： IC MPU 512K FLASH 66MHZ 388-PBGA
標(biāo)準(zhǔn)包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 56
程序存儲器容量： 512KB（512K x 8）
程序存儲器類型： 閃存
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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MPC561/MPC563 Reference Manual, Rev. 1.2
Freescale Semiconductor
RegIndex-5
MIOS14RPR0 request pending register
MIOS14RPR1 request pending register
MIOS14SR0 interrupt status register
MIOS14SR1interrupt status register
MIOS14TPCR (test and pin control register)
MISCNT (MISC counter)
MMCSMCNT (MMCSM up-counter register)
MMCSMMML (MMCSM modulus latch register)
MMCSMSCR
(MMCSMstatus/control
register)
MPIOSMDDR (MPIOSM data direction register)
MPIOSMDR (MPIOSM data register)
MPWMCNTR (MPWMSM counter register)
MPWMPERR (MPWMSM period register)
MPWMPULR (MPWMSM pulse width register)
MPWMSCR (MPWMSM status/control register)
MSTAT (memory controller status registers)
10-32
OR0 - OR3 (memory controller option registers 0-3)
PDMCR (pads module configuration register)
PDMCR2 (pads module configuration register)
PISCR (periodic interrupt status and control register)
PITC (periodic interrupt timer count register)
PITR (periodic interrupt timer register)
PLPRCR (PLL, low-power, and reset-control register)
Port data direction registers
Port data registers
PPMMCR (module confguration register)
PPMPCR (PPM control register)
QACR0 (QADC64E control register 0)
QACR1 (QADC64E control register 1)
QACR2 (QADC64E control register 2)
QADCINT (QADC64E interrupt register)
QADCMCR (module configuration register)
QASR (status register 0)
QASR (status registers)
QSMCM
configuration register (QMCMMCR)
interrupt level registers (QDSCI_IL, QSPI_IL)
port QS data register (PORTQS)
PORTQS data direction register (DDRQS)
PORTQS pin assignment register (PQSPAR)
QSCI1 control register (QSCI1CR)
QSCI1 status register (QSCI1SR)
QSPI command RAM (CRx)
QSPI control register 0 (SPCR0)
QSPI control register 1 (SPCR1)
QSPI control register 2 (SPCR2)
QSPI control register 3 (SPCR3)
QSPI registers
QSPI status register (SPSR)
queued SCI1 status and control registers
SCI control register 0 (SCCxR0)
SCI control register 1 (SCCxR1)
SCI data register (SCxDR)
SCI registers
SCI status register (SCxSR)
test register (QTEST)
RCPU
additional
implementation-specific
registers
condition register (CR)
condition register CR0 field definition
condition register CR1 field definition
condition register crn field - compare instruction
count register (CTR)
dae/source instruction service register (DSISR)
data address register (DAR)
decrementer register (DEC)
EIE, EID, and NRI special-purpose registers
floating-point exception cause register (FPECR)
floating-point registers (FPRs)
floating-point status and control register (FPSCR)
general
special-purpose
registers
(SPRG0-SPRG3)
general-purpose registers (GPRs)
implementation-specific special-purpose registers
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link register (LR)
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