參數(shù)資料
型號(hào)： MPC5554MZP132
廠商： Freescale Semiconductor
文件頁數(shù)： 28/58頁
文件大小： 0K
描述： IC MCU 2M FLASH 132MHZ 416-PBGA
產(chǎn)品培訓(xùn)模塊： MPC55xx PitchPak Family
標(biāo)準(zhǔn)包裝： 40
系列： MPC55xx Qorivva
核心處理器： e200z6
芯體尺寸： 32-位
速度： 132MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 256
程序存儲(chǔ)器容量： 2MB（2M x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.35 V ~ 1.65 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 40x12b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 416-BBGA
包裝： 托盤
配用： MPC5554INT-ND - BOARD DEMO MPC5554
MPC5554EVBISYS-ND - BOARD EVAL ISYSTEMS MPC5554
MPC5554EVBGHS-ND - BOARD EVAL GREEN HILLS SOFTWARE
MPC5554EVB-ND - BOARD EVALUATION MPC5554
MPC5534EVBISYS-ND - KIT EVAL ISYSTEMS MPC5534
MPC5534EVBGHS-ND - KIT EVAL GREEN HILLS SOFTWARE
MPC5534EVB-ND - KIT EVALUATION MPC5534MZP80
MPC5554EVBE-ND - BOARD EVAL FOR MPC5554
MPC5534EVBE-ND - BOARD EVAL FOR MPC5534
MPC5554 Microcontroller Data Sheet, Rev. 4
Electrical Characteristics
Freescale Semiconductor
34
7
Input signal valid to CLKOUT
positive edge (setup time)
External bus interface
ADDR[8:31]
DATA[0:31] 7
BG 6
BR 5
BB
RD_WR
TA
TEA 8
TS
tCIS
10.0
—
7.0
—
5.0
—
ns
8
CLKOUT positive edge to input
signal invalid (hold time)
External bus interface
ADDR[8:31]
DATA[0:31] 7
BG 6
BR 5
BB
RD_WR
TA
TEA 8
TS
tCIH
1.0
—
1.0
—
1.0
—
ns
1 EBI timing specified at: V
DDE = 1.6–3.6 V (unless stated otherwise); TA = TL to TH; and CL = 30 pF with DSC = 0b10.
2 Speed is the nominal maximum frequency. Max. speed is the maximum speed allowed including frequency modulation (FM).
82 MHz parts allow for 80 MHz system clock + 2% FM; 114 MHz parts allow for 112 MHz system clock + 2% FM; and
132 MHz parts allow for 128 MHz system clock + 2% FM.
3 The external bus is limited to half the speed of the internal bus.
4 Refer to fast pad timing in Table 17 and Table 18 (different values for 1.8 V and 3.3 V).
5 Internal arbitration.
6 External arbitration.
7 Due to pin limitations, the DATA[16:31] signals are not available on the 324 package.
8 Due to pin limitations, the TEA signal is not available on the 324 package.
9 Due to pin limitations, the WE/BE[2:3] signals are not available on the 324 package.
10 SIU_ECCR[EBTS] = 0 timings are tested and valid at V
DDE = 2.25–3.6 V only; SIU_ECCR[EBTS] = 1 timings are tested and
valid at VDDE = 1.6–3.6 V.
Table 22. Bus Operation Timing1 (continued)
Spec
Characteristic
and
Description
Symbol
External Bus Frequency 2, 3
Unit
Notes
40 MHz
56 MHz
66 MHz
Min.
Max.
Min.
Max.
Min.
Max.
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