參數(shù)資料
型號(hào)： MPC5200CVR466BR2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, 400 MHz, MICROPROCESSOR, PBGA272
封裝： 27 X 27 MM, 1.27 MM PITCH, ROHS COMPLIANT, PLASTIC, BGA-272
文件頁(yè)數(shù)： 52/72頁(yè)
文件大小： 978K
代理商： MPC5200CVR466BR2
MPC5200B Data Sheet, Rev. 4
56
Freescale Semiconductor
1.3.18
IEEE 1149.1 (JTAG) AC Specifications
Figure 46. Timing Diagram—JTAG Clock Input
Figure 47. Timing Diagram—JTAG TRST
Table 51. JTAG Timing Specification
Sym
Characteristic
Min
Max
Unit
SpecID
—
TCK frequency of operation.
0
25
MHz
A17.1
1
TCK cycle time.
40
—
ns
A17.2
2
TCK clock pulse width measured at 1.5V.
1.08
—
ns
A17.3
3
TCK rise and fall times.
0
3
ns
A17.4
4TRST setup time to tck falling edge(1).
1 TRST is an asynchronous signal. The setup time is for test purposes only.
10
—
ns
A17.5
5TRST assert time.
5
—
ns
A17.6
6
Input data setup time(2).
2 Non-test, other than TDI and TMS, signal input timing with respect to TCK.
5
—
ns
A17.7
7
Input data hold time(2)
.
15
—
ns
A17.8
8
TCK to output data valid(3).
3 Non-test, other than TDO, signal output timing with respect to TCK.
030
ns
A17.9
9
TCK to output high impedance(3).
0
30
ns
A17.10
10
TMS, TDI data setup time.
5
—
ns
A17.11
11
TMS, TDI data hold time.
1
—
ns
A17.12
12
TCK to TDO data valid.
0
15
ns
A17.13
13
TCK to TDO high impedance.
0
15
ns
A17.14
TCK
VM
3
22
1
VM = Midpoint Voltage
Numbers shown reference Table 51.
TCK
TRST
5
4
Numbers shown reference Table 51.
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PDF描述
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