參數(shù)資料
型號: MPC5200CBV400
廠商: Freescale Semiconductor
文件頁數(shù): 22/80頁
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描述: IC MPU 32BIT 400MHZ PPC 272-PBGA
標(biāo)準(zhǔn)包裝: 40
系列: MPC52xx
核心處理器: 603e G2 LE
芯體尺寸: 32-位
速度: 400MHz
連通性: CAN,EBI/EMI,以太網(wǎng),I²C,IrDA,J1850,SPI,UART/USART,USB
外圍設(shè)備: AC'97,DMA,I²S,POR,PWM,WDT
輸入/輸出數(shù): 56
程序存儲器類型: 外部程序存儲器
RAM 容量: 16K x 8
電壓 - 電源 (Vcc/Vdd): 1.42 V ~ 1.58 V
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 272-BBGA
包裝: 托盤
Electrical and Thermal Characteristics
MPC5200 Data Sheet, Rev. 4
Freescale Semiconductor
29
NOTES:
1. ACK can shorten the CS pulse width.
Wait States (WS) can be programmed in the Chip Select X Register, Bit field WaitP and WaitX. It can be specified from
0 - 65535.
2. In Large Flash and MOST Graphics mode the shared PCI/ATA pins, used as address lines, are released at the same moment
as the CS. This can cause that the address is changing earlier as CS is deasserted.
3. ACK is input and can be used to shorten the CS pulse width.
4. Only available in Large Flash and MOST Graphics mode.
5. Only available in MOST Graphics mode.
Figure 12. Timing Diagram—Non-MUXed Mode
t14
TS assertion before CS assertion
-
0.8
ns
4
A7.16
t15
TS pulse width
tPCIck
ns
4
A7.17
t16
TSIZ valid before CS assertion
tIPBIck
-ns
5
A7.18
t17
TSIZ hold after CS negation
tIPBIck
-ns
5
A7.19
Table 24. Non-MUXed Mode Timing (continued)
Sym
Description
Min
Max
Units
Notes
SpecID
ADDR
DATA (rd)
CS[x]
R/W
DATA (wr)
OE
t10
t11
TS
t2
t6
t8
t7
t4
t3
t9
TSIZ[1:2]
t5
t17
t16
ACK
t12
t13
t14
t15
t1
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