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參數(shù)資料
| 型號(hào)： | MN101CP54CAL |
| 廠商： | PANASONIC CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 14 MM, 0.65 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁(yè)數(shù)： | 541/544頁(yè) |
| 文件大小： | 2900K |
| 代理商： | MN101CP54CAL |
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Chapter 3
Interrupts
III - 10
Overview
nInterrupt Acceptance Operation
When accepting an interrupt, the MN101C54 hardware saves the handy address register, the return
address from the program counter, and the processor status word (PSW) to the stack and branches
program to the interrupt handler using the starting address in the vector table.
The following is the hardware processing sequence invoked by interrupt acceptance.
1.
The stack pointer (SP) is updated.
(SP-6
→ SP)
2.
The contents of the handy address register (HA) are saved to the stack.
Upper half of HA
→ (SP+5)
Lower half of HA
→ (SP+4)
3.
The contents of the program counter (PC) -i.e., the return
address- are saved to the stack.
PC bits 18, 17, and 0
→ (SP+3)
PC bits 16-9
→ (SP+2)
PC bits 8-1
→ (SP+1)
4.
The contents of the PSW are saved to the stack.
PSW
→ (SP)
5.
The interrupt level (xxxLVn) for the interrupt is copied to
the interrupt mask (IMn) in the PSW.
Interrupt level (xxxLVn)
→ IMn
6.
The hardware branches program to the address
in the vector table.
nInterrupt Return Operation
An interrupt handler ends by restoring the contents of any registers saved to the stack during processing
by the POP instruction and other means, and the RTI instruction restores the program to the point at
execution was interrupted.
The following is the processing sequence invoked by the RTI instruction.
1.
The contents of the PSW are restored from the stack. (SP)
2.
The contents of the program counter (PC) - i.e., the return address- are restored from the stack.
(SP+1 to SP+3)
3.
The contents of the handy address register (HA) are restored from the stack. (SP+4, SP+5)
4.
The stack pointer is updated. (SP+6
→ SP)
5.
Execution branches program to the address in the program counter.
The handy address register is an internal register used by the handy addressing function. The hardware
saves its contents to the stack to prevent the interrupt from interfering with operation of the function.
PSW
New SP
(after interrupt
acceptance)
7
0
PC8 - 1
PC16 - 9
PC 18,17
reserved
HA 7 - 0
HA 15 - 8
PC0
Old SP
(before interrupt
acceptance)
Lower
Address
Higher
Figure 3-1-5
Stack Operation
during interrupt acceptance
Registers such as data register, or address register are not saved, so that PUSH instruction
from program should be used to save them onto the stack, if necessary.
The address bp6 to bp2, when program counter (PC) are saved to the stack, are reserved.
Do not change it by program.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MN101CF73A | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP64 |
| MN101D01Y | 8-BIT, OTPROM, MICROCONTROLLER, PQFP100 |
| MN101D01F | 8-BIT, OTPROM, MICROCONTROLLER, PQFP100 |
| MN102H60M | 16-BIT, MROM, 34 MHz, MICROCONTROLLER, PQFP100 |
| MN103SB5K | 32-BIT, MROM, 60 MHz, MICROCONTROLLER, PQFP64 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MN101D01FPA4 | 制造商:Panasonic Industrial Company 功能描述:IC |
| MN101D01GPC1 | 制造商:Panasonic Industrial Company 功能描述:IC |
| MN101D02D | 制造商:PANASONIC 制造商全稱:Panasonic Semiconductor 功能描述:Microcomputers/Controllers |
| MN101D02F | 制造商:PANASONIC 制造商全稱:Panasonic Semiconductor 功能描述:Microcomputers/Controllers |
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