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參數(shù)資料
| 型號： | MN101CF54DBF |
| 廠商： | PANASONIC CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 18 X 18 MM, 0.80 MM PITCH, PLASTIC, QFP-84 |
| 文件頁數(shù)： | 375/544頁 |
| 文件大?。?/td> | 2900K |
| 代理商： | MN101CF54DBF |
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Chapter 13 A/D Converter
Operation
XIII - 10
nA/D Converter Sampling Time (Ts) Setup
The sampling time of A/D converter is set with the ANSH1 to 0 flag of the ANCTR0 register. The sam-
pling time of A/D converter depends on external circuit, so set the right value by analog input impedance.
Table 13-3-3
Sampling Time of A/D Conversion and A/D Conversion Time
nA/D Converter Clock Setup
The A/D converter clock is set with the ANCK1 to 0 flag of the ANCTR0 register. Set the A/D converter
clock (TAD) more than 800 ns and less than 15.26
s. Table 13-3-2 shows the machine clock (fosc, fx, fs)
and the A/D converter clock (TAD). (calculated as fs = fosc/2, fx/4)
Table 13-3-2
A/D Conversion Clock and A/D Conversion Cycle
Table 13-3-1
Input Pins of A/D Converter Setup
13-3-1
Setup
nInput Pins of A/D Converter Setup
Input pins for A/D converter is selected by the ANCH2 to 0 flag of the ANCTR1 register.
For the system clock (fs), refer to Chapter 2. 2-5 Clock Switching.
2
S
H
C
N
A1
S
H
C
N
A0
S
H
C
N
An
i
p
D
/
A
0
0n
i
p
0
N
A
1
n
i
p
1
N
A
1
0
n
i
p
2
N
A
1
n
i
p
3
N
A
1
0
n
i
p
4
N
A
1
n
i
p
5
N
A
1
0
n
i
p
6
N
A
1
n
i
p
7
N
A
ANCK1
ANCK0
A/D conversion
clock
A/D conversion cycle (TAD)
at high speed oscillation
at low speed
oscillation
at fosc=20 MHz
at fosc=8.38 MHz at fx=32.768 kHz
0
0fs/2
200.00 ns
(unusable)
477.33 ns
(unusable )
244.14 s
(unusable )
1
fs/4
400.00ns
(unusable)
954.65ns
488.28 s
(unusable )
1
0
fs/8
800.00 ns
1.91 s
976.56 s
(unusable )
1
fx x 2
15.26 s
ANSH1
ANSH0
Sampling time
(Ts)
A/D conversion time
at TAD=800 ns at TAD=954.65 ns
at TAD=1.91 s
at TAD=15.26 s
0
0TAD x 2
9.60 s
11.46 s
22.92 s
183.12 s
1
TAD x 6
12.80 s
15.27 s
30.56 s
244.16 s
1
0TAD x 18
22.40 s
26.73 s
53.48 s
427.28 s
1
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