參數資料
型號： MM912F634CV1AE
廠商： Freescale Semiconductor
文件頁數： 41/339頁
文件大?。?/td> 0K
描述： IC MCU 16BIT 32KB FLASH 48LQFP
標準包裝： 250
核心處理器： HCS12
芯體尺寸： 16-位
速度： 20MHz
連通性： LIN，SCI
外圍設備： POR，PWM，WDT
輸入/輸出數： 9
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.25 V ~ 5.5 V
數據轉換器： A/D 15x10b
振蕩器型： 外部
工作溫度： -40°C ~ 105°C
封裝/外殼： 48-LQFP 裸露焊盤
包裝： 托盤
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Functional Description and Application Information
Basic Timer Module - TIM (TIM16B4C)
MM912F634
Freescale Semiconductor
135
4.18.3.3.10
Timer Interrupt Enable Register (TIE)
4.18.3.3.11
Timer System Control Register 2 (TSCR2)
NOTE
This mode of operation is similar to an up-counting modulus counter.
If register TC3 = $0000 and TCRE = 1, the timer counter register (TCNT) will stay at $0000
continuously. If register TC3 = $FFFF and TCRE = 1, TOF will not be set when the timer
counter register (TCNT) is reset from $FFFF to $0000.
The newly selected prescale factor will not take effect until the next synchronized edge,
where all prescale counter stages equal zero.
Table 171. Edge Detector Circuit Configuration
EDGnB
EDGnA
Configuration
0
Capture disabled
0
1
Capture on rising edges only
1
0
Capture on falling edges only
1
Capture on any edge (rising or falling)
Table 172. Timer Interrupt Enable Register (TIE)
Offset(127) 0xCA
Access: User read/write
76
543
210
R
0
000
C3I
C2I
C1I
C0I
W
Reset
0
000
00
Note:
127. Offset related to 0x0200 for blocking access and 0x300 for non blocking access within the global address space.
Table 173. TIE - Register Field Descriptions
Field
Description
3-0
C[3-0]I
Input Capture/Output Compare Interrupt Enable.
1 = Enables corresponding Interrupt flag (CnF of TFLG1 register) to cause a hardware interrupt
0 = Disables corresponding Interrupt flag (CnF of TFLG1 register) from causing a hardware interrupt
Table 174. Timer System Control Register 2 (TSCR2)
Offset(128) 0xCB
Access: User read/write
76
543
210
R
TOI
000
TCRE
PR2
PR1
PR0
W
Reset
0
000
00
Note:
128. Offset related to 0x0200 for blocking access and 0x300 for non blocking access within the global address space.
Table 175. TIE - Register Field Descriptions
Field
Description
7
TOI
Timer Overflow Interrupt Enable
1 = Hardware interrupt requested when TOF flag set in TFLG2 register.
0 = Hardware Interrupt request inhibited.
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PDF描述
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