參數(shù)資料
型號： MM74HC04SJX
廠商： Fairchild Semiconductor
文件頁數(shù)： 4/9頁
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描述： IC HEX INVERTER 14-SOP
標準包裝： 2,000
系列： 74HC
邏輯類型： 逆變器，緩沖器
電路數(shù)： 6
輸入數(shù)： 1
電源電壓： 2 V ~ 6 V
電流 - 靜態(tài)（最大值）： 2µA
輸出電流高，低： 5.2mA，5.2mA
邏輯電平 - 低： 0.5 V ~ 1.8 V
邏輯電平 - 高： 1.5 V ~ 4.2 V
額定電壓和最大 CL 時的最大傳播延遲： 16ns @ 6V，50pF
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
供應商設備封裝： 14-SOIC
封裝/外殼： 14-SOIC（0.209"，5.30mm 寬）
包裝： 帶卷 (TR)
1983 Fairchild Semiconductor Corporation
www.fairchildsemi.com
MM74HC04 Rev. 1.3.0
4
MM74HC04
—
He
x
In
ver
ter
AC Electrical Characteristics
VCC = 5V, TA = 25°C, CL = 15pF, tr = tf = 6ns
AC Electrical Characteristics
VCC = 2.0V to 6.0V, CL = 50pF, tr = tf = 6ns (unless otherwise specified)
Note:
4. CPD determines the no load dynamic power consumption, PD = CPD VCC
2 f + I
CC VCC, and the no load dynamic
current consumption, IS = CPD VCC f + ICC.
Symbol
Parameter
Conditions
Typ.
Guaranteed
Limit
Units
tPHL, tPLH
Maximum Propagation Delay
8
15
ns
Symbol
Parameter
VCC (V) Conditions
TA = 25°C
TA = –40°C
to 85°C
TA = –55°C
to 125°C
Units
Typ.
Guaranteed Limits
tPHL, tPLH
Maximum
Propagation Delay
2.0
55
95
120
145
ns
4.5
11
19
24
29
6.0
9
16
20
24
tTLH, tTHL
Maximum Output
Rise and Fall Time
2.0
30
75
95
110
ns
4.5
8
15
19
22
6.0
7
13
16
19
CPD
Power Dissipation
Capacitance(4)
(per gate)
20
pF
CIN
Maximum Input
Capacitance
510
10
pF
相關PDF資料
PDF描述
OSTV7165151 TERM BLOCK PLUG 5.08MM 16POS
OSTV7175150 TERM BLOCK PLUG 5.08MM 17POS
OSTTJ085152 CONN TERM BLK PLUG 8POS 5.08MM
OSTVL187151 CONN TERM BLK HEADER 18POS 5MM
OSTVL187150 CONN TERM BLK HEADER 18POS 5MM
相關代理商/技術參數(shù)
參數(shù)描述
MM74HC04SJX_NL 功能描述:變換器 RoHS:否 制造商:NXP Semiconductors 電路數(shù)量:6 邏輯系列:74ABT 邏輯類型:BiCMOS 高電平輸出電流:- 15 mA 低電平輸出電流:20 mA 傳播延遲時間:2.2 ns 電源電壓-最大:5.5 V 電源電壓-最小:4.5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 工作溫度范圍: 封裝 / 箱體:DIP-14 封裝:Tube
MM74HC05 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Hex Inverter (Open Drain)
MM74HC05J 制造商:Texas Instruments 功能描述:
MM74HC08 制造商:FAIRCHILD 制造商全稱:Fairchild Semiconductor 功能描述:Quad 2-Input AND Gate
MM74HC08J/A+ 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Quad 2-input AND Gate
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