參數(shù)資料
型號: ML64P168-XXXGA
廠商: LAPIS SEMICONDUCTOR CO LTD
元件分類: 微控制器/微處理器
英文描述: 4-BIT, OTPROM, 0.7 MHz, MICROCONTROLLER, PQFP80
封裝: 14 X 14 MM, 0.65 MM PITCH, PLASTIC, QFP-80
文件頁數(shù): 15/295頁
文件大小: 1488K
代理商: ML64P168-XXXGA
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8-3
ML64168/P168 User's Manual
Chapter 8 Serial Port (SIOP)
8
Figure 8-2 Serial Port Operation Time Chart
8.3 Operation of Serial Port
By setting the ENTR bit of the Serial port control register (SCON) to "1" after writing send data
to the Serial port buffers (SBUFH and SBUFL), serial transfer begins. When serial transfer
is finished, the SEND bit of SCON is set to "1" and the Serial port interrupt request SIOINT
is generated. The vector address of the Serial port interrupt request is at address 035H.
When serial transfer is finished, receive data is written to SBUFH and SBUFL. It is not
necessary to write send data if only the receive operation is performed.
The SDIR bit of SCON is used to select the direction of transfer data and if SDIR is reset to
"0", MSB of SBUFH and SBUFL becomes head data and if SDIR is set to "1", LSB becomes
head data.
The EXSC bit of SCON is used to select transfer clocks. When EXSC is reset to "0", the
system clock is selected as the transfer clock and the system clock is output to the P4.2/SCLK
pin. By setting EXSC to "1", the external clock can be selected as the transfer clock and those
clocks input from the P4.2/SCLK pin become the transfer clocks.
Figure 8-2 shows the operation time chart of the serial port.
0
1234567
0
1234567
r
w
e
P4.1/SPR
P4.2/SCLK
P4.0/SOUT
P3.3/SIN
tCLK
1/2 tCLK
Set by software
ENTR
SBUFH,
SBUFL
SR
SIOINT
Send data
o
q
y
Interrupt request
o
t
Receive data
Reset by
hardware
1/2 tCLK
When internal clock generated
y
1/2 tCLK
tCLK : period of system clock
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PDF描述
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