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參數(shù)資料
| 型號(hào)： | ML63514A-XXXTP |
| 廠商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | PLASTIC, TQFP-64 |
| 文件頁數(shù)： | 239/250頁 |
| 文件大?。?/td> | 1326K |
| 代理商： | ML63514A-XXXTP |
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7-8
ML63512A/514A User's Manual
Chapter 7 Timers (TIMER)
(4) Timer status registers (TM0STAT, TM1STAT)
Timer status registers read the status of each timer.
At system reset, all valid bits are cleared to "0".
Timer 0 Registers
—
TM0CAP
TM0OVF
TM0STAT (074H)
(R)
bit 3
bit 2
bit 1
bit 0
Timer 0 capture flag
0: No new capture data (initial value)
1: New capture data
Timer 0 overflow flag
0: Initial value
1:
Toggles between 0 and 1 each time the timer 0 counter register overflows.
bit 1: TM0CAP (TiMer0 CAPture)
This bit indicates whether or not new capture data is present.
When TM0CAP = "0":
A value of "0" indicates that there has been no new capture data since
system reset or since the last time TM0CAP was read.
When TM0CAP = "1":
A value of "1" indicates that there is new capture data since system reset
or since the last time TM0CAP was read. Additional captures are disabled.
At system reset, TM0CAP is cleared to "0".
In the capture mode, if the level of the capture input pin (P1.0/TM0CAP)
changes and a capture is generated, TM0CAP is automatically set to "1".
If TM0STAT is read, TM0CAP is automatically cleared to "0".
bit 0: TM0OVF (TiMer0 OVerFlow)
This bit indicates that the timer counter register has overflowed.
This bit toggles between "0" and "1" whenever overflow occurs.
At system reset, TM0OVF is cleared to "0".
Timer 1 Registers
—
TM1CAP
TM1OVF
TM1STAT (075H)
(R)
bit 3
bit 2
bit 1
bit 0
Timer 1 capture flag
0: No new capture data (initial value)
1: New capture data
Timer 1 overflow flag
0: Initial value
1:
Toggles between 0 and 1 each time the timer 1 counter register overflows.
相關(guān)PDF資料 |
PDF描述 |
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