參數(shù)資料
型號： MK50DN512ZCLL10R
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, LQFP-100
文件頁數(shù)： 14/73頁
文件大?。?/td> 991K
代理商： MK50DN512ZCLL10R
Table 9. Device clock specifications (continued)
Symbol
Description
Min.
Max.
Unit
Notes
fFLASH
Flash clock
—
1
MHz
fLPTMR
LPTMR clock
—
25
MHz
5.2.2 General switching specifications
These general purpose specifications apply to all signals configured for GPIO, UART,
CMT, and I2C signals.
Table 10. General switching specifications
Symbol
Description
Min.
Max.
Unit
Notes
GPIO pin interrupt pulse width (digital glitch filter
disabled) — Synchronous path
1.5
—
Bus clock
cycles
GPIO pin interrupt pulse width (digital glitch filter
disabled, analog filter enabled) — Asynchronous path
100
—
ns
GPIO pin interrupt pulse width (digital glitch filter
disabled, analog filter disabled) — Asynchronous path
16
—
ns
External reset pulse width (digital glitch filter disabled)
100
—
ns
Mode select (EZP_CS) hold time after reset
deassertion
2
—
Bus clock
cycles
Port rise and fall time (high drive strength)
Slew disabled
1.71 ≤ VDD ≤ 2.7V
2.7 ≤ VDD ≤ 3.6V
Slew enabled
1.71 ≤ VDD ≤ 2.7V
2.7 ≤ VDD ≤ 3.6V
—
12
TBD
36
TBD
ns
Port rise and fall time (low drive strength)
Slew disabled
1.71 ≤ VDD ≤ 2.7V
2.7 ≤ VDD ≤ 3.6V
Slew enabled
1.71 ≤ VDD ≤ 2.7V
2.7 ≤ VDD ≤ 3.6V
—
32
TBD
36
TBD
ns
1. The greater synchronous and asynchronous timing must be met.
General
K50 Sub-Family Data Sheet Data Sheet, Rev. 5, 5/2011.
Freescale Semiconductor, Inc.
Preliminary
21
相關(guān)PDF資料
PDF描述
MK50DX256ZCLL10R 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP100
MK50DX256ZCMB10 FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA81
MK50DX256ZCLK10 FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP80
MK51DX256ZCLK10R 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PQFP80
MK51DX256ZCMB10R 32-BIT, FLASH, 100 MHz, RISC MICROCONTROLLER, PBGA81
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參數(shù)描述
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