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參數(shù)資料
| 型號： | MK2771-16RLF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 3/7頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK SRC VCXO/SET-TOP 28-QSOP |
| 標(biāo)準(zhǔn)包裝： | 48 |
| 類型： | 時鐘合成器，VCXO |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | CMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:8 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 50MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SSOP（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-QSOP |
| 包裝： | 管件 |
MK2771-16
VCXO AND SET-TOP CLOCK SOURCE
VCXO AND SYNTHESIZER
IDT VCXO AND SET-TOP CLOCK SOURCE
3
MK2771-16
REV G 051310
Pin Descriptions
Pin
Number
Pin
Name
Pin Type
Pin Description
1
PS0
Input
Processor clock select 0. Selects PCLK frequency. See table
above. Internal pull-up resistor.
2
X2
XO
Crystal connection. Connect to a 13.5 MHz fundamental mode
pullable crystal.
3, 10, 11
GND
Power
Connect to ground.
4
X1
XI
Crystal connection. Connect to a 13.5 MHz fundamental mode
pullable crystal.
5, 8, 22
VDD5
Power
Connect to +5 V.
6
VIN
Input
Voltage input to VCXO. Zero to 3 V signal which controls the
frequency of the VCXO.
7
VDDIO
Power
Connect to +3.3 V or +5 V. Amplitude of inputs and outputs will
match this.
9
CS1
Input
Communications clock select pin 1. Selects CCLK 1 and 2 per
table above. Internal pull-up.
12
PCLK
Output
Processor clock output. Determined by status of PS1, PS0.
13
CCLK2
Output
Communications clock output 2 determined by status of CS1,
CS0 per table above.
14
ACLK
Output
Audio clock output. Determined by status of AS2:0 per table
above.
15
13.5M
Output
13.5 MHz VCXO clock output.
16
PS1
Tri-level Input Processor Clock Select 1. Selects PCLK frequency. See table
above. Self-biased to M.
17
CCLK1
Output
Communications clock output 1 determined by status of CS1,
CS0 per table above.
18, 23, 25
27M
Output
27 MHz VCXO clock output.
19, 20, 24
GND
Power
Connect to ground.
21
AS2
Input
Audio clock select 2. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
26
CS0
Input
Communications clock select pin 0. Selects CCLK 1 and 2 per
table above. Internal pull-up.
27
AS0
Input
Audio clock select 0. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
28
AS1
Input
Audio clock select 1. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
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PDF描述 |
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