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參數(shù)資料
| 型號： | MK2771-15RTR |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時(shí)鐘產(chǎn)生/分配 |
| 英文描述： | 100 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO28 |
| 封裝： | SSOP-28 |
| 文件頁數(shù)： | 3/7頁 |
| 文件大?。?/td> | 182K |
| 代理商： | MK2771-15RTR |
MK2771-15
VCXO AND SET-TOP CLOCK SOURCE
VCXO AND SYNTHESIZER
IDT / ICS VCXO AND SET-TOP CLOCK SOURCE
3
MK2771-15
REV F 032204
Pin Descriptions
Pin
Number
Pin
Name
Pin Type
Pin Description
1
PCS0
Input
Processor clock select 0. Selects PCLKs on pins 11 and 12. See
table above. Internal pull-up resistor.
2
X2
XO
Crystal connection. Connect to a pullable 13.5 MHz crystal.
3
X1
XI
Crystal connection. Connect to a pullable 13.5 MHz crystal.
4, 5, 8
VDD
Power
Connect to +5 V.
6
VIN
Input
Voltage input to VCXO. Zero to 3 V signal which controls the
frequency of the VCXO.
7
VDDIO
Power
Connect to +3.3 V or +5 V. Amplitude of inputs must, and outputs
will, match this.
9
SC
Tri-level input Communications clock select pin. Biased to M level if floating
10, 18,
19, 24
GND
Power
Connect to ground.
11
PCLK1
Output
Processor clock output number 1. Determined by status of
PCS2:0.
12
PCLK2
Output
Processor clock output number 2. Determined by status of
PCS2:0.
13
PCS1
Input
Processor clock select 1. Selects PCLKs on pins 11 and 12. See
table above. Internal pull-up resistor.
14
ACLK
Output
Audio clock output. Determined by status of ACS1, ACS0 per
table above.
15
DC
—
Don’t Connect anything to this pin.
16
13.5M
Output
13.50 MHz VCXO clock output.
17
CCLK2
Output
Communications clock output 2 determined by status of SC per
table above.
20
PCS2
Input
Processor clock select 2. Selects PCLKs on pins 11 and 12. See
table above. Internal pull-up resistor.
21, 22
VDD
Power
Connect to +5 V.
23
CCLK1
Output
Communications clock output 1 determined by status of SC per
table above.
25
27M
Output
27.00 MHz VCXO clock output.
26
54M
Output
54.00 MHz VCXO clock output.
27
ACS0
Input
Audio clock select 0. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
28
ACS1
Input
Audio clock select 1. Selects ACLK on pin 14. See table above.
Internal pull-up resistor.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MK2771-16RLFTR | 50 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO28 |
| MK2771-16R | 50 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO28 |
| MK3233-02STR | 50 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| MK3233-02S | 50 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| MK3235-01S | 14.3 MHz, OTHER CLOCK GENERATOR, PDSO16 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MK2771-16RTR | 功能描述:IC CLK SRC VCXO/SET-TOP 28-QSOP RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:39 系列:- 類型:* PLL:帶旁路 輸入:時(shí)鐘 輸出:時(shí)鐘 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 頻率 - 最大:170MHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:* 封裝/外殼:* 供應(yīng)商設(shè)備封裝:* 包裝:* |
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