參數(shù)資料
型號： MK2761ASLF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 4/7頁
文件大?。?/td> 0K
描述： IC CLK SOURCE SET-TOP 16-SOIC
標(biāo)準(zhǔn)包裝： 48
類型： 時(shí)鐘/頻率合成器
PLL： 帶旁路
輸入： 時(shí)鐘，晶體
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 無/無
頻率 - 最大： 27MHz
除法器/乘法器： 無/無
電源電壓： 4.5 V ~ 5.5 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC
包裝： 管件
MK2761A
SET-TOP CLOCK SOURCE
CLOCK SYNTHESIZER
IDT SET-TOP CLOCK SOURCE
4
MK2761A
REV F 051310
DC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
° C
Note 1: With ACLK clock at 12.28 MHz.
AC Electrical Characteristics
VDD = 5.0 V ±10% (unless otherwise noted), Temp 0 to +70
° C
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
4.5
5.5
V
Input High Voltage
VIH
X1/ICLK pin only
3.5
2.5
V
Input Low Voltage
VIL
X1/ICLK pin only
2.5
1.5
V
Input High Voltage
VIH
2V
Input Low Voltage
VIL
0.8
V
Output High Voltage
VOH
IOH = -25 mA
2.4
V
Output Low Voltage
VOL
IOL = 25 mA
0.4
V
Output High Voltage, CMOS
level
VOH
IOH = -8 mA
VDD-0.4
V
Operating Supply Current
IDD
No load, Note 1
65
mA
Short Circuit Current
IOS
Each output
±100
mA
Input Capacitance
CIN
7pF
Frequency Error, ACLK
0
ppm
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
27
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V
1.5
ns
Output Clock Fall Time
tOF
2.0 to 0.8 V
1.5
ns
Output Clock Duty Cycle
At 1.4 V
40
60
%
Absolute Jitter, short term
Variation from mean
±250
ps
Skew of 27 MHz Outputs
Rising edges at 1.4 V
-500
0
500
ps
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PDF描述
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參數(shù)描述
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MK2761ASTR 功能描述:IC CLK SOURCE SET-TOP 16-SOIC RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:39 系列:- 類型:* PLL:帶旁路 輸入:時(shí)鐘 輸出:時(shí)鐘 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 頻率 - 最大:170MHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:* 封裝/外殼:* 供應(yīng)商設(shè)備封裝:* 包裝:*
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