參數(shù)資料
型號(hào)： MK2746-01GLF
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 27 MHz, OTHER CLOCK GENERATOR, PDSO16
封裝： 4.40 MM, 0.65 MM PITCH, TSSOP-16
文件頁數(shù)： 4/5頁
文件大小： 105K
代理商： MK2746-01GLF
USB-DVR CLOCK SOURCE
MDS 2746 -01 C
4
Revision 041906
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 295-9 800 ● www.icst.com
MK2746-01
DC Electrical Characteristics
VDD=3.3V ±10% , Ambient temperature 0 to +70°C, unless stated otherwise
AC Electrical Characteristics
VDD = 3.3V ±10%, Ambient Temperature 0 to +70° C, unless stated otherwise
Note 1: Measured with 15pF load.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.0
3.6
V
Input High Voltage
VIH
2.0
V
Input Low Voltage
VIL
0.8
V
Input High Voltage
VIH
ICLK
(VDD/2)-1
VDD/2
V
Input Low Voltage
VIL
ICLK
VDD/2
(VDD/2)+1
V
Output High Voltage
VOH
IOH = -20 mA
2.4
V
Output Low Voltage
VOL
IOL = 20 mA
0.4
V
Output High Voltage (CMOS
Level)
VOH
IOH = -4 mA
VDD-0.4
V
Operating Supply Current
IDD
No load, OE=1
21
mA
No load, OE=0
15
mA
Short Circuit Current
IOS
±50
mA
Input Capacitance
CIN
5pF
Nominal Output Impedance
ZOUT
20
On Chip Pull Up Resistor
RPU
510
k
On Chip Pull Down Resistor
RPD
240
k
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
27
MHz
Output Rise Time
tOR
20% to 80% of VDD, Note 1
1.2
1.8
ns
Output Fall Time
tOF
80% to 20% of VDD, Note 1
1.2
1.8
ns
Output Clock Duty Cycle
tD
at VDD/2, Note 1
45
50
55
%
Maximum Output Jitter,
short term
tJ
All clocks, except REF clocks
Note 1
+75
ps
REF clocks, Note 1
+150
ps
Output Enable time
OE high to valid output (PLL
running)
20
ns
Output Disable time
OE low to output disable
20
ns
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PDF描述
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參數(shù)描述
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