參數(shù)資料
型號: MK2308S-1T
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘及定時
英文描述: 2308 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
封裝: 0.150 INCH, SOIC-16
文件頁數(shù): 1/7頁
文件大小: 187K
代理商: MK2308S-1T
DATASHEET
3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
MK2308-1
IDT / ICS 3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
1
MK2308-1
REV B 012805
Description
The MK2308-1 is a low phase noise, high-speed PLL
based, 8-output, low-skew zero delay buffer. Based on
IDT’s proprietary low jitter Phase Locked Loop (PLL)
techniques, the device provides eight low skew outputs at
speeds up to 133 MHz at 3.3 V. The outputs can be
generated from the PLL (for zero delay), or directly from the
input (for testing), and can be set to tri-state mode or to stop
at a low level. For normal operation as a zero delay buffer,
any output clock is tied to the FBIN pin.
Features
Clock outputs from 10 to 133 MHz
Zero input-output delay
Eight low skew (<200 ps) outputs
Device-to-device skew <700 ps
Full CMOS outputs with 25 mA output drive capability at
TTL levels
5 V tolerant FBIN and CLKIN pins
Tri-state mode for board-level testing
Advanced, low power, sub-micron CMOS process
Operating voltage of 3.3 V
Industrial temperature range available
Available in Pb (lead) free package
Packaged in 16-pin SOIC
Block Diagram
CLKA4
CLKB1
CLKA3
CLKB2
CLKB3
CLKA2
CLKA1
CLKB4
CLKIN
Control
Logic
1
0
S2, S1
2
Clock
Synthesis
PLL
FBIN
Feedback is shown from CLKB4 for
illustration, but may come from any output.
VDD
2
GND
2
相關PDF資料
PDF描述
MK2308S-1IT 2308 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
MK2745-24SILF PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
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MK2745-24SILFT PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
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參數(shù)描述
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