參數(shù)資料
型號(hào)： MK2308G-1HLFTR
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 1/8頁(yè)
文件大?。?/td> 0K
描述： IC PLL ZD BUFFER HS 16-TSSOP
標(biāo)準(zhǔn)包裝： 2,500
類(lèi)型： 零延遲緩沖器
PLL： 帶旁路
輸入： 時(shí)鐘
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:8
差分 - 輸入:輸出： 無(wú)/無(wú)
頻率 - 最大： 133MHz
除法器/乘法器： 無(wú)/無(wú)
電源電壓： 3 V ~ 3.6 V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 帶卷 (TR)
DATASHEET
3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
MK2308-1H
IDT / ICS 3.3 VOLT ZERO DELAY, LOW SKEW BUFFER
1
MK2308-1H
REV G 051310
Description
The MK2308-1H is a low phase noise, high-speed PLL
based, 8-output, low skew zero delay buffer. Based on IDT’s
proprietary low jitter Phase Locked Loop (PLL) techniques,
the device provides eight low skew outputs at speeds up to
133 MHz at 3.3 V. The outputs can be generated from the
PLL (for zero delay), or directly from the input (for testing),
and can be set to tri-state mode or to stop at a low level. For
normal operation as a zero delay buffer, any output clock is
tied to the FBIN pin.
IDT manufactures a large variety of clock generators and
buffers.
Features
Clock outputs from 10 to 133 MHz
Zero input-output delay
Eight low skew (<200 ps) outputs
Device-to-device skew <700 ps
Full CMOS outputs with 25 mA output drive capability at
TTL levels
5 V tolerant FBIN and CLKIN pins
Tri-state mode for board-level testing
Advanced, low-power, sub-micron CMOS process
Operating voltage of 3.3 V
Industrial temperature range available
Packaged in 16-pin SOIC and TSSOP packages
Pb (lead) free package
Industrial and commercial temp operation
Block Diagram
CLKA4
CLKB1
CLKA3
CLKB2
CLKB3
CLKA2
CLKA1
CLKB4
CLKIN
Control
Logic
1
0
S2, S1
2
Clock
Synthesis
PLL
FBIN
Feedback is shown from CLKB4 for
illustration, but may come from any output.
VDD
2
GND
2
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PDF描述
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參數(shù)描述
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