參數(shù)資料
型號(hào)： MK20DX256ZVLL10
廠(chǎng)商： Freescale Semiconductor
文件頁(yè)數(shù)： 19/74頁(yè)
文件大小： 0K
描述： IC ARM CORTEX MCU 256KB 100LQFP
標(biāo)準(zhǔn)包裝： 450
系列： Kinetis
核心處理器： ARM? Cortex?-M4
芯體尺寸： 32-位
速度： 100MHz
連通性： CAN，EBI/EMI，I²C，IrDA，SDHC，SPI，UART/USART，USB，USB OTG
外圍設(shè)備： DMA，I²S，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 66
程序存儲(chǔ)器容量： 256KB（256K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 64K x 8
電壓 - 電源 (Vcc/Vdd)： 1.71 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 25x16b，D/A 1x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 100-LQFP
包裝： 托盤(pán)
Table 14. JTAG full voltage range electricals (continued)
Symbol
Description
Min.
Max.
Unit
J5
Boundary scan input data setup time to TCLK rise
20
—
ns
J6
Boundary scan input data hold time after TCLK rise
0
—
ns
J7
TCLK low to boundary scan output data valid
—
25
ns
J8
TCLK low to boundary scan output high-Z
—
25
ns
J9
TMS, TDI input data setup time to TCLK rise
8
—
ns
J10
TMS, TDI input data hold time after TCLK rise
1.4
—
ns
J11
TCLK low to TDO data valid
—
22.1
ns
J12
TCLK low to TDO high-Z
—
22.1
ns
J13
TRST assert time
100
—
ns
J14
TRST setup time (negation) to TCLK high
8
—
ns
J2
J3
J4
TCLK (input)
Figure 5. Test clock input timing
J7
J8
J7
J5
J6
Input data valid
Output data valid
TCLK
Data inputs
Data outputs
Figure 6. Boundary scan (JTAG) timing
Peripheral operating requirements and behaviors
K20 Sub-Family Data Sheet Data Sheet, Rev. 7, 02/2013.
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Freescale Semiconductor, Inc.
相關(guān)PDF資料
PDF描述
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1588153-3 BOOT 1.6MM-2.0MM BLACK
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參數(shù)描述
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MK20DX256ZVMD10 功能描述:ARM微控制器 - MCU KINETIS CORTEX M4 256KFLEX USB RoHS:否 制造商:STMicroelectronics 核心:ARM Cortex M4F 處理器系列:STM32F373xx 數(shù)據(jù)總線(xiàn)寬度:32 bit 最大時(shí)鐘頻率:72 MHz 程序存儲(chǔ)器大小:256 KB 數(shù)據(jù) RAM 大小:32 KB 片上 ADC:Yes 工作電源電壓:1.65 V to 3.6 V, 2 V to 3.6 V, 2.2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:LQFP-48 安裝風(fēng)格:SMD/SMT
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