參數(shù)資料
型號： MK1574-01SILF
元件分類： 時鐘及定時
英文描述： PLL BASED CLOCK DRIVER, PDSO16
封裝： 0.150 INCH, SOIC-16
文件頁數(shù)： 7/8頁
文件大小： 188K
代理商： MK1574-01SILF
3.3 VOLT FRAME RATE COMMUNICATIONS PLL
MDS 1574-01 E
7
Revision 062105
Integrated Circuit Systems l 525 Race Street, San Jose, CA 95126 l tel (408) 297-1201 l
www.icst.com
MK1574-01
Loop Filter Constants
This table shows the constants K1 and K2 that are used with the equations on page 6 to calculate the external loop
filter components.
Loop Filter Contstants for MK1574-01
PC Board Layout
A proper board layout is critical to the successful use of the MK1574-01. In particular, the CAP1 and CAP2
pins are very sensitive to noise and leakage (CAP1 at pin 4 is the most sensitive). Traces must be as short
as possible and the capacitor and resistor must be mounted next to the device as shown to the right. The
capacitor connected between pins 3 and 5 is the power supply decoupling capacitor. The high frequency
output clocks on may benefit from a series 33
resistor connected close to the pin (not shown).
Decode
Address
Loop Filter Constants
FS3:0
(Hex)
K1
K2
0000
0
Reserved
0001
1
Reserved
0010
2
Reserved
0011
3
Reserved
0100
4
0.0430
7.4
0101
5
0.0527
6.0
0110
6
0.0444
7.2
0111
7
0.0454
7.0
1000
8
0.0533
6.0
1001
9
0.0410
7.8
1010
A
0.0508
6.3
1011
B
0.0587
5.4
1100
C
0.0365
8.7
1101
D
0.0420
7.6
1110
E
0.0516
6.2
1111
F
0.0594
5.4
相關(guān)PDF資料
PDF描述
MK1574-01SILFTR PLL BASED CLOCK DRIVER, PDSO16
MK1574-01SLFTR 1574 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
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MK1575-01GI PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
MK1575-01G 1575 SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
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參數(shù)描述
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MK1574-01SLFTR 功能描述:時鐘合成器/抖動清除器 3.3V FRAME RATE COMMUNICATION PLL RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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