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參數(shù)資料
| 型號： | MD83C154TXXX-L16P883D |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| 封裝： | 0.600 INCH, CERAMIC, DIP-40 |
| 文件頁數(shù)： | 88/431頁 |
| 文件大?。?/td> | 5137K |
| 代理商： | MD83C154TXXX-L16P883D |
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178
7682C–AUTO–04/08
AT90CAN32/64/128
17.4
Clock Generation
The Clock Generation logic generates the base clock for the Transmitter and Receiver. The
USARTn supports four modes of clock operation: Normal asynchronous, Double Speed asyn-
chronous, Master synchronous and Slave synchronous mode. The UMSELn bit in USARTn
Control and Status Register C (UCSRnC) selects between asynchronous and synchronous
operation. Double Speed (asynchronous mode only) is controlled by the U2Xn found in the
UCSRnA Register. When using synchronous mode (UMSELn = 1), the Data Direction Register
for the XCKn pin (DDR_XCKn) controls whether the clock source is internal (Master mode) or
external (Slave mode). The XCKn pin is only active when using synchronous mode.
Figure 17-2 shows a block diagram of the clock generation logic.
Figure 17-2. USARTn Clock Generation Logic, Block Diagram
Signal description:
txn clk
Transmitter clock (Internal Signal).
rxn clk
Receiver base clock (Internal Signal).
xn cki
Input from XCK pin (internal Signal). Used for synchronous slave
operation.
xn cko
Clock output to XCK pin (Internal Signal). Used for synchronous master
operation.
fclk
io
System I/O Clock frequency.
17.4.1
Internal Clock Generation – Baud Rate Generator
Internal clock generation is used for the asynchronous and the synchronous master modes of
operation. The description in this section refers to Figure 17-2.
The USARTn Baud Rate Register (UBRRn) and the down-counter connected to it function as a
programmable prescaler or baud rate generator. The down-counter, running at system clock
(
fclk
io), is loaded with the UBRRn value each time the counter has counted down to zero or
when the UBRRnL Register is written. A clock is generated each time the counter reaches zero.
This clock is the baud rate generator clock output (=
fclk
io/(UBRRn+1)). The Transmitter divides
the baud rate generator clock output by 2, 8 or 16 depending on mode. The baud rate generator
output is used directly by the Receiver’s clock and data recovery units. However, the recovery
Prescaling
Down-Counter
/2
UBRRn
/4
/2
Sync
Register
clk
XCKn
Pin
txn
clk
U2Xn
UMSELn
DDR_XCKn
0
1
0
1
xn
cki
xn
cko
DDR_XCKn
rxn
clk
0
1
0
Edge
Detector
UCPOLn
io
UBRRn+1
fclk
io
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MD83C154XXX-L16P883D | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| MQ80C32E-16SB | 8-BIT, 16 MHz, MICROCONTROLLER, CQFP44 |
| MS80C51T-16D | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQCC44 |
| MR83C154TXXX-12/883D | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
| MD80C32-12SHXXX:D | 8-BIT, 12 MHz, MICROCONTROLLER, CDIP40 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MD8412B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LINK(IEEE 1394) |
| MD8451H-8/B | 制造商:undefined 功能描述: |
| MD845A-R2 | 制造商:Black Box Corporation 功能描述:MODEM 202 |
| MD845A-R2-W1 | 制造商:Black Box Corporation 功能描述:1 YEAR WARRANTY FOR MD845A-R2 |
| MD845A-R2-W3 | 制造商:Black Box Corporation 功能描述:3 YEAR WARRANTY FOR MD845A-R2 |
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