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參數(shù)資料
| 型號： | MD80C52XXX-20SCD |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁數(shù)： | 94/336頁 |
| 文件大小： | 8801K |
| 代理商： | MD80C52XXX-20SCD |
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183
ATmega16M1/32M1/64M1 [DATASHEET]
8209E–AVR–11/2012
Bit 7 – DLCW: Data Length Code Warning
The incoming message does not have the DLC expected. Whatever the frame type, the DLC field of the CANCD-
MOB register is updated by the received DLC.
Bit 6 – TXOK: Transmit OK
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
The communication enabled by transmission is completed. TxOK rises at the end of EOF field. When the controller
is ready to send a frame, if two or more message objects are enabled as producers, the lower MOb index (0 to 14)
is supplied first.
Bit 5 – RXOK: Receive OK
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
The communication enabled by reception is completed. RxOK rises at the end of the 6
th bit of EOF field. In case of
two or more message object reception hits, the lower MOb index (0 to 14) is updated first.
Bit 4 – BERR: Bit Error (Only in Transmission)
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
The bit value monitored is different from the bit value sent.
Exceptions: the monitored recessive bit sent as a dominant bit during the arbitration field and the acknowledge slot
detecting a dominant bit during the sending of an error frame.
Bit 3 – SERR: Stuff Error
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
Detection of more than five consecutive bits with the same polarity. This flag can generate an interrupt.
Bit 2 – CERR: CRC Error
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
The receiver performs a CRC check on every de-stuffed received message from the start of frame up to the data
field. If this checking does not match with the de-stuffed CRC field, a CRC error is set.
Bit 1 – FERR: Form Error
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
The form error results from one or more violations of the fixed form in the following bit fields:
CRC delimiter
Acknowledgment delimiter
EOF
Bit 0 – AERR: Acknowledgment Error
This flag can generate an interrupt. It must be cleared using a read-modify-write software routine on the whole
CANSTMOB register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MD80C32E-36SBD | 8-BIT, 36 MHz, MICROCONTROLLER, CDIP40 |
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| MR80C32E-30SCD | 8-BIT, 30 MHz, MICROCONTROLLER, CQCC44 |
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參數(shù)描述 |
|---|---|
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| MD80C862 | 制造商:Intel 功能描述:PROCESSOR:MICRO-PROCESSOR |
| MD80C86-2 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C86-2/883 | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube 制造商:Rochester Electronics LLC 功能描述:CPU 16BILT 5V CMOS 8MHZ 40CDIP - Bulk |
| MD80C86-2/B | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube |
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