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參數(shù)資料
| 型號： | MCP4152T-502E/MF |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 42/59頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC POT DGTL SNGL 5K RHEO 8DFN |
| 標(biāo)準(zhǔn)包裝： | 3,300 |
| 接片： | 257 |
| 電阻（歐姆）： | 5k |
| 電路數(shù)： | 1 |
| 溫度系數(shù)： | 標(biāo)準(zhǔn)值 150 ppm/°C |
| 存儲器類型： | 易失 |
| 接口： | 4 線 SPI（芯片選擇） |
| 電源電壓： | 1.8 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-VDFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 8-DFN-EP（3x3） |
| 包裝： | 帶卷 (TR) |
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Micrel, Inc.
KSZ8051MNL/RNL
July 2010
47
M9999-070910-1.0
MII Transmit Timing (10Base-T)
Figure 10. MII Transmit Timing (10Base-T)
Timing Parameter
Description
Min
Typ
Max
Unit
tP
TXC period
400
ns
tWL
TXC pulse width low
200
ns
tWH
TXC pulse width high
200
ns
tSU1
TXD[3:0] setup to rising edge of TXC
120
ns
tSU2
TXEN setup to rising edge of TXC
120
ns
tHD1
TXD[3:0] hold from rising edge of TXC
0
ns
tHD2
TXEN hold from rising edge of TXC
0
ns
tCRS1
TXEN high to CRS asserted latency
200
ns
tCRS2
TXEN low to CRS de-asserted latency
550
ns
Table 11. MII Transmit Timing (10Base-T) Parameters
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