- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄25626 > MC9S12XEP768VVLR (FREESCALE SEMICONDUCTOR INC) 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 PDF資料下載
參數(shù)資料
| 型號(hào)： | MC9S12XEP768VVLR |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PBGA208 |
| 封裝： | MAPBGA-208 |
| 文件頁(yè)數(shù)： | 493/1410頁(yè) |
| 文件大?。?/td> | 8299K |
| 代理商： | MC9S12XEP768VVLR |
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Chapter 2 Port Integration Module (S12XEPIMV1)
MC9S12XE-Family Reference Manual , Rev. 1.13
172
Freescale Semiconductor
NOTE
Due to internal synchronization circuits, it can take up to 2 bus clock cycles
until the correct value is read on PTF or PTIF registers, when changing the
DDRF register.
2.3.104 Port F Reduced Drive Register (RDRF)
2.3.105 Port F Pull Device Enable Register (PERF)
Address 0x037B
Access: User read/write(1)
1. Read: Anytime.
Write: Anytime.
76543210
R
RDRF7
RDRF6
RDRF5
RDRF4
RDRF3
RDRF2
RDRF1
RDRF0
W
Reset
00000000
Figure 2-102. Port F Reduced Drive Register (RDRF)
Table 2-98. RDRF Register Field Descriptions
Field
Description
7-0
RDRF
Port F reduced drive—Select reduced drive for outputs
This register congures the drive strength of output pins 7 through 0 as either full or reduced. If a pin is used as input
this bit has no effect.
1 Reduced drive selected (1/6 of the full drive strength).
0 Full drive strength enabled.
Address 0x037C
Access: User read/write(1)
1. Read: Anytime.
Write: Anytime.
76543210
R
PERF7
PERF6
PERF5
PERF4
PERF3
PERF2
PERF1
PERF0
W
Reset
11111111
Figure 2-103. Port F Pull Device Enable Register (PERF)
Table 2-99. PERF Register Field Descriptions
Field
Description
7-0
PERF
Port F pull device enable—Enable pull devices on input pins
These bits congure whether a pull device is activated, if the associated pin is used as an input. This bit has no effect
if the pin is used as an output. Out of reset all pull devices are enabled.
1 Pull device enabled.
0 Pull device disabled.
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