參數(shù)資料
型號(hào)： MC9S12P96J0MFT
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QCC48
封裝： 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, MO-220VKKD-2, QFN-48
文件頁(yè)數(shù)： 54/528頁(yè)
文件大小： 6002K
代理商： MC9S12P96J0MFT
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S12S Debug (S12SDBG) Module
S12P-Family Reference Manual, Rev. 1.07
Freescale Semiconductor
PRELIMINARY
147
6.4.5.2.1
Normal Mode
In Normal Mode, change of ow (COF) program counter (PC) addresses are stored.
COF addresses are dened as follows:
Source address of taken conditional branches (long, short, bit-conditional, and loop primitives)
Destination address of indexed JMP, JSR, and CALL instruction
Destination address of RTI, RTS, and RTC instructions
Vector address of interrupts, except for BDM vectors
LBRA, BRA, BSR, BGND as well as non-indexed JMP, JSR, and CALL instructions are not classied as
change of ow and are not stored in the trace buffer.
Stored information includes the full 18-bit address bus and information bits, which contains a
source/destination bit to indicate whether the stored address was a source address or destination address.
NOTE
When a COF instruction with destination address is executed, the
destination address is stored to the trace buffer on instruction completion,
indicating the COF has taken place. If an interrupt occurs simultaneously
then the next instruction carried out is actually from the interrupt service
routine. The instruction at the destination address of the original program
ow gets executed after the interrupt service routine.
In the following example an IRQ interrupt occurs during execution of the
indexed JMP at address MARK1. The BRN at the destination (SUB_1) is
not executed until after the IRQ service routine but the destination address
is entered into the trace buffer to indicate that the indexed JMP COF has
taken place.
LDX
#SUB_1
MARK1
JMP
0,X
; IRQ interrupt occurs during execution of this
MARK2
NOP
;
SUB_1
BRN
*
; JMP Destination address TRACE BUFFER ENTRY 1
; RTI Destination address TRACE BUFFER ENTRY 3
NOP
;
ADDR1
DBNE
A,PART5
; Source address TRACE BUFFER ENTRY 4
IRQ_ISR
LDAB
#$F0
; IRQ Vector $FFF2 = TRACE BUFFER ENTRY 2
STAB
VAR_C1
RTI
;
The execution ow taking into account the IRQ is as follows
LDX
#SUB_1
MARK1
JMP
0,X
;
IRQ_ISR
LDAB
#$F0
;
STAB
VAR_C1
RTI
;
SUB_1
BRN
*
NOP
;
ADDR1
DBNE
A,PART5
;
相關(guān)PDF資料
PDF描述
MC9S12P96J0MLH MICROCONTROLLER, PQFP64
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MC9S12P96J0CQK MICROCONTROLLER, PQFP80
MC9S12P96J0MQKR MICROCONTROLLER, PQFP80
MC9S12P96J0VQK MICROCONTROLLER, PQFP80
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參數(shù)描述
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MC9S12Q128CFU 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 CISC 128KB FLASH 2.5V/5V 80PQFP - Bulk
MC9S12Q128VFAE16 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 CISC 128KB FLASH 2.5V/5V 48LQFP - Bulk
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