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  • 參數(shù)資料
    型號: MC9S12GC64PVFU25
    廠商: MOTOROLA INC
    元件分類: 微控制器/微處理器
    英文描述: 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80
    封裝: QFP-80
    文件頁數(shù): 3/136頁
    文件大?。?/td> 2022K
    代理商: MC9S12GC64PVFU25
    Device User Guide — 9S12C128DGV1/D V01.05
    100
    beyond the power supply levels that it ties to. If the input level goes outside of this range it will effectively
    be clipped
    B.4.3 Factors influencing accuracy
    Three factors - source resistance, source capacitance and current injection - have an influenceon the
    accuracy of the ATD.
    B.4.3.1 Source Resistance:
    Due to the input pin leakage current as specified in Table A-6 in conjunction with the source resistance
    there will be a voltage drop from the signal source to the ATD input. The maximum source resistance RS
    specifies results in an error of less than 1/2 LSB (2.5mV) at the maximum leakage current. If device or
    operating conditions are less than worst case or leakage-induced error is acceptable, larger values of source
    resistance is allowable.
    B.4.3.2 Source capacitance
    When sampling an additional internal capacitor is switched to the input. This can cause a voltage drop due
    to charge sharing with the external and the pin capacitance. For a maximum sampling error of the input
    voltage
    ≤ 1LSB, then the external filter capacitor, C
    f ≥ 1024 * (CINS- CINN).
    Table B-4 ATD Operating Characteristics
    Conditions are shown in Table A-4 unless otherwise noted; Supply Voltage 3.3V-10% <= VDDA <= 3.3V+10%
    Num C
    Rating
    Symbol
    Min
    Typ
    Max
    Unit
    1D
    Reference Potential
    Low
    High
    VRL
    VRH
    VSSA
    VDDA/2
    VDDA
    V
    2
    C Differential Reference Voltage
    VRH-VRL
    3.0
    3.3
    3.6
    V
    3
    D ATD Clock Frequency
    fATDCLK
    0.5
    2.0
    MHz
    4D
    ATD 10-Bit Conversion Period
    Clock Cycles1
    Conv, Time at 2.0MHz ATD Clock fATDCLK
    NOTES:
    1. The minimum time assumes a final sample period of 2 ATD clocks cycles while the maximum time assumes a final sample
    period of 16 ATD clocks.
    NCONV10
    TCONV10
    14
    7
    28
    14
    Cycles
    s
    5D
    ATD 8-Bit Conversion Period
    Clock Cycles(1)
    Conv, Time at 2.0MHz ATD Clock fATDCLK
    NCONV8
    TCONV8
    12
    6
    26
    13
    Cycles
    s
    6D Recovery Time (VDDA=3.3 Volts)
    tREC
    20
    s
    7
    P
    Reference Supply current
    IREF
    0.250
    mA
    相關(guān)PDF資料
    PDF描述
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    參數(shù)描述
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