• 參數(shù)資料
    型號(hào): MC9S12GC128VFA25
    廠商: FREESCALE SEMICONDUCTOR INC
    元件分類: 微控制器/微處理器
    英文描述: 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP48
    封裝: LQFP-48
    文件頁(yè)數(shù): 107/138頁(yè)
    文件大?。?/td> 2318K
    代理商: MC9S12GC128VFA25
    第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)當(dāng)前第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)
    Device User Guide — 9S12C128DGV1/D V01.07
    68
    4.4.1 Stop
    Executing the CPU STOP instruction stops all clocks and the oscillator thus putting the chip in fully static
    mode. Wake up from this mode can be done via reset or external interrupts.
    4.4.2 Pseudo Stop
    This mode is entered by executing the CPU STOP instruction. In this mode the oscillator is still running
    and the Real Time Interrupt (RTI) or Watchdog (COP) sub module can stay active. Other peripherals are
    turned off. This mode consumes more current than the full STOP mode, but the wake up time from this
    mode is significantly shorter.
    4.4.3 Wait
    This mode is entered by executing the CPU WAI instruction. In this mode the CPU will not execute
    instructions. The internal CPU signals (address and databus) will be fully static. All peripherals stay active.
    For further power consumption reduction the peripherals can individually turn off their local clocks.
    4.4.4 Run
    Although this is not a low power mode, unused peripheral modules should not be enabled in order to save
    power.
    Section 5 Resets and Interrupts
    5.1 Overview
    Consult the Exception Processing section of the CPU12 Reference Manual for information.
    5.2 Vectors
    5.2.1 Vector Table
    Table 5-1 lists interrupt sources and vectors in default order of priority.
    Table 5-1 Interrupt Vector Locations
    Vector Address
    Interrupt Source
    CCR
    Mask
    Local Enable
    HPRIO Value
    to Elevate
    $FFFE, $FFFF
    External Reset, Power On Reset or Low
    Voltage Reset (see CRG Flags Register
    to determine reset source)
    None
    $FFFC, $FFFD
    Clock Monitor fail reset
    None
    COPCTL (CME, FCME)
    $FFFA, $FFFB
    COP failure reset
    None
    COP rate select
    $FFF8, $FFF9
    Unimplemented instruction trap
    None
    F
    re
    e
    sc
    a
    le
    S
    e
    m
    ic
    o
    n
    d
    u
    c
    to
    r,
    I
    Freescale Semiconductor, Inc.
    For More Information On This Product,
    Go to: www.freescale.com
    n
    c
    ..
    .
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    PDF描述
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