參數(shù)資料
型號(hào)： MC9S12C96VFU16
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP80
封裝： PLASTIC, QFP-80
文件頁(yè)數(shù)： 678/684頁(yè)
文件大?。?/td> 7367K
代理商： MC9S12C96VFU16
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Chapter 2 Port Integration Module (PIM9C32) Block Description
Freescale Semiconductor
MC9S12C-Family / MC9S12GC-Family
93
Rev 01.20
2.3.2.3.3
Port M Data Direction Register (DDRM)
Read: Anytime.
Write: Anytime.
Module Base + 0x0012
76543210
R0
0
DDRM5
DDRM4
DDRM3
DDRM2
DDRM1
DDRM0
W
Reset
—
0
00000
= Unimplemented or Reserved
Figure 2-19. Port M Data Direction Register (DDRM)
Table 2-17. DDRM Field Descriptions
Field
Description
5–0
DDRM[5:0]
Data Direction Port M — This register congures each port S pin as either input or output
If SPI or MSCAN is enabled, the SPI and MSCAN modules determines the pin directions. Please refer to the SPI
and MSCAN Block User Guides for details.
If the associated SCI or MSCAN transmit or receive channels are enabled, this register has no effect on the pins.
The pins are forced to be outputs if the SCI or MSCAN transmit channels are enabled, they are forced to be inputs
if the SCI or MSCAN receive channels are enabled.
The DDRS bits revert to controlling the I/O direction of a pin when the associated channel is disabled.
0 Associated pin is congured as input.
1 Associated pin is congured as output.
Note: Due to internal synchronization circuits, it can take up to 2 bus cycles until the correct value is read on PTM
or PTIM registers, when changing the DDRM register.
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PDF描述
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