參數(shù)資料
型號(hào)： MC9S12C32CPB
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP52
封裝： LQFP-52
文件頁(yè)數(shù)： 17/94頁(yè)
文件大小： 906K
代理商： MC9S12C32CPB
Device User Guide — 9S12C32DGV1/D V01.01
24
2.1.1 Pin Initialization for 48 & 52 Pin LQFP bond-out versions
Not Bonded Pins If the port pins are not bonded out in the chosen package the user should initialize the
registers to be inputs with enabled pull resistance to avoid excess current consumption. This applies to the
following pins:
(48LQFP): Port A[7:1], Port B[7:5], Port B[3:0], PortE[6,5,3,2], Port P[7:6], PortP[4:0], Port J[7:6],
PortS[3:2]
(52LQFP): Port A[7:3], Port B[7:5], Port B[3:0], PortE[6,5,3,2], Port P[7:6], PortP[2:0], Port J[7:6],
PortS[3:2]
PA[7:3]
ADDR[15:11]/
DATA[15:11]
—
Port A I/O pin & multiplexed address/data
Input
VDDX
PA[2:1]
ADDR[10:9]/
DATA[10:9]
—
Port A I/O pin & multiplexed address/data
Input
VDDX
PA[0]
ADDR[8]/
DATA[8]
—
Port A I/O pin & multiplexed address/data
Input
VDDX
PB[7:5]
ADDR[7:5]/
DATA[7:5]
—
Port B I/O pin & multiplexed address/data
Input
VDDX
PB[4]
ADDR[4]/
DATA[4]
—
Port B I/O pin & multiplexed address/data
Input
VDDX
PB[3:0]
ADDR[3:0]/
DATA[3:0]
—
Port B I/O pin & multiplexed address/data
Input
VDDX
PAD[7:0]
AN[7:0]
—
Port AD I/O pins and ATD inputs
Input
VDDA
PP[7]
KWP[7]
—
Port P I/O Pins and keypad wake-up
Input
VDDX
PP[6]
KWP[6]
ROMONE
Port P I/O Pins, keypad wake-up and ROMON
enable.
Input
VDDX
PP[5]
KWP[5]
PW5
Port P I/O Pin, keypad wake-up, PW5 output
Input
VDDX
PP[4:3]
KWP[4:3]
PW[4:3]
Port P I/O Pin, keypad wake-up, PWM output
Input
VDDX
PP[2:0]
KWP[2:0]
PW[2:0]
Port P I/O Pins, keypad wake-up, PWM outputs
Input
VDDX
PJ[7:6]
KWJ[7:6]
—
Port J I/O Pins and keypad wake-up
Input
VDDX
PM5
SCK
—
Port M I/O Pin and SPI SCK signal
Input
VDDX
PM4
MOSI
—
Port M I/O Pin and SPI MOSI signal
Input
VDDX
PM3
SS
—
Port M I/O Pin and SPI SS signal
Input
VDDX
PM2
MISO
—
Port M I/O Pin and SPI MISO signal
Input
VDDX
PM1
TXCAN
—
Port M I/O Pin and CAN transmit signal
Input
VDDX
PM0
RXCAN
—
Port M I/O Pin and CAN receive signal
Input
VDDX
PS[3:2]
—
Port S I/O Pins
Input
VDDX
PS1
TXD
—
Port S I/O Pin and SCI transmit signal
Input
VDDX
PS0
RXD
—
Port S I/O Pin and SCI receive signal
Input
VDDX
PT[7:5]
IOC[7:5]
—
Port T I/O Pins shared with timer (TIM)
Input
VDDX
PT[4:0]
IOC[4:0]
PW[4:0]
Port T I/O Pins shared with timer and PWM
Input
VDDX
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Description
Reset
State
Power
Domain
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PDF描述
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