參數(shù)資料
型號： MC9S12C128VFUE
廠商： Freescale Semiconductor
文件頁數(shù)： 395/690頁
文件大?。?/td> 0K
描述： IC MCU 128K FLASH 25MHZ 80-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HCS12
核心處理器： HCS12
芯體尺寸： 16-位
速度： 25MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 60
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 4K x 8
電壓 - 電源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 80-QFP
包裝： 托盤
產(chǎn)品目錄頁面： 731 (CN2011-ZH PDF)
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Chapter 15 Timer Module (TIM16B8CV1) Block Description
454
MC9S12C-Family / MC9S12GC-Family
Freescale Semiconductor
Rev 01.24
15.3.2.15 16-Bit Pulse Accumulator Control Register (PACTL)
When PAEN is set, the PACT is enabled.The PACT shares the input pin with IOC7.
Read: Any time
Write: Any time
Module Base + 0x0020
76543210
R0
PAEN
PAMOD
PEDGE
CLK1
CLK0
PAOVI
PAI
W
Reset
0
00000
Unimplemented or Reserved
Figure 15-24. 16-Bit Pulse Accumulator Control Register (PACTL)
Table 15-19. PACTL Field Descriptions
Field
Description
6
PAEN
Pulse Accumulator System Enable — PAEN is independent from TEN. With timer disabled, the pulse
accumulator can function unless pulse accumulator is disabled.
0 16-Bit Pulse Accumulator system disabled.
1 Pulse Accumulator system enabled.
5
PAMOD
Pulse Accumulator Mode — This bit is active only when the Pulse Accumulator is enabled (PAEN = 1). See
0 Event counter mode.
1 Gated time accumulation mode.
4
PEDGE
Pulse Accumulator Edge Control — This bit is active only when the Pulse Accumulator is enabled (PAEN = 1).
For PAMOD bit = 0 (event counter mode). See Table 15-20.
0 Falling edges on IOC7 pin cause the count to be incremented.
1 Rising edges on IOC7 pin cause the count to be incremented.
For PAMOD bit = 1 (gated time accumulation mode).
0 IOC7 input pin high enables M (bus clock) divided by 64 clock to Pulse Accumulator and the trailing falling
edge on IOC7 sets the PAIF ag.
1 IOC7 input pin low enables M (bus clock) divided by 64 clock to Pulse Accumulator and the trailing rising edge
on IOC7 sets the PAIF ag.
3:2
CLK[1:0]
Clock Select Bits — Refer to Table 15-21.
1
PAOVI
Pulse Accumulator Overow Interrupt Enable
0 Interrupt inhibited.
1 Interrupt requested if PAOVF is set.
0
PAI
Pulse Accumulator Input Interrupt Enable
0 Interrupt inhibited.
1 Interrupt requested if PAIF is set.
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PDF描述
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