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參數(shù)資料
| 型號： | MC9S08LC36LK |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 117/360頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 36K FLASH 2K RAM 80-LQFP |
| 標準包裝： | 96 |
| 系列： | S08 |
| 核心處理器： | S08 |
| 芯體尺寸： | 8-位 |
| 速度： | 40MHz |
| 連通性： | I²C，SCI，SPI |
| 外圍設備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 24 |
| 程序存儲器容量： | 36KB（36K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2.5K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉換器： | A/D 8x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 80-LQFP |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 729 (CN2011-ZH PDF) |
| 配用： | DEMO9S08LC60-ND - BOARD DEMO FOR 9S08LC60 |
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Chapter 11 Timer/Pulse-Width Modulator (S08TPMV2)
MC9S08LC60 Series Data Sheet: Technical Data, Rev. 4
Freescale Semiconductor
203
11.3.2
Timer x Counter Registers (TPMxCNTH:TPMxCNTL)
The two read-only TPM counter registers contain the high and low bytes of the value in the TPM counter.
Reading either byte (TPMxCNTH or TPMxCNTL) latches the contents of both bytes into a buffer where
they remain latched until the other byte is read. This allows coherent 16-bit reads in either order. The
coherency mechanism is automatically restarted by an MCU reset, a write of any value to TPMxCNTH or
TPMxCNTL, or any write to the timer status/control register (TPMxSC).
Reset clears the TPM counter registers.
Table 11-2. TPM Clock Source Selection
CLKSB:CLKSA
TPM Clock Source to Prescaler Input
0:0
No clock selected (TPMx disabled)
0:1
Bus rate clock (BUSCLK)
1:0
Fixed system clock (XCLK)
1:1
External source (TPMxCLK)1,2
1 The maximum frequency that is allowed as an external clock is one-fourth of the bus
frequency.
2 If the external clock input is shared with channel n and is selected as the TPM clock source,
the corresponding ELSnB:ELSnA control bits should be set to 0:0 so channel n does not try
to use the same pin for a conicting function.
Table 11-3. Prescale Divisor Selection
PS2:PS1:PS0
TPM Clock Source Divided-By
0:0:0
1
0:0:1
2
0:1:0
4
0:1:1
8
1:0:0
16
1:0:1
32
1:1:0
64
1:1:1
128
76543210
R
Bit 15
14
13
12
11
10
9
Bit 8
W
Any write to TPMxCNTH clears the 16-bit counter.
Reset
00000000
Figure 11-4. Timer x Counter Register High (TPMxCNTH)
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