參數(shù)資料
型號: MC908QT4AMPE
廠商: Freescale Semiconductor
文件頁數(shù): 12/202頁
文件大?。?/td> 0K
描述: IC MCU 8BIT 4K FLASH 8-DIP
標準包裝: 50
系列: HC08
核心處理器: HC08
芯體尺寸: 8-位
速度: 8MHz
外圍設(shè)備: LVD,POR,PWM
輸入/輸出數(shù): 5
程序存儲器容量: 4KB(4K x 8)
程序存儲器類型: 閃存
RAM 容量: 128 x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 6x10b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 125°C
封裝/外殼: 8-DIP(0.300",7.62mm)
包裝: 管件
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Port B
MC68HC908QYA/QTA Family Data Sheet, Rev. 3
Freescale Semiconductor
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12.4.2 Data Direction Register B
Data direction register B (DDRB) determines whether each port B pin is an input or an output. Writing a 1
to a DDRB bit enables the output buffer for the corresponding port B pin; a 0 disables the output buffer.
DDRB[7:0] — Data Direction Register B Bits
These read/write bits control port B data direction. Reset clears DDRB[7:0], configuring all port B pins
as inputs.
1 = Corresponding port B pin configured as output
0 = Corresponding port B pin configured as input
NOTE
Avoid glitches on port B pins by writing to the port B data register before
changing data direction register B bits from 0 to 1. Figure 12-7 shows the
port B I/O logic.
Figure 12-7. Port B I/O Circuit
When DDRBx is a 1, reading PTB reads the PTBx data latch. When DDRBx is a 0, reading PTB reads
the logic level on the PTBx pin. The data latch can always be written, regardless of the state of its data
direction bit.
Bit 7
654
32
1
Bit 0
Read:
DDRB7
DDRB6
DDRB5
DDRB4
DDRB3
DDRB2
DDRB1
DDRB0
Write:
Reset:
0
000
00
Figure 12-6. Data Direction Register B (DDRB)
READ DDRB
WRITE DDRB
RESET
WRITE PTB
READ PTB
PTBx
DDRBx
PTBx
IN
TERNAL
DATA
BUS
PULLUP
PTBPUEx
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PDF描述
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參數(shù)描述
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