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參數(shù)資料
| 型號： | MC908QT1VDW |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO8 |
| 封裝： | EIAJ, SOIC-8 |
| 文件頁數(shù)： | 127/184頁 |
| 文件大?。?/td> | 1763K |
| 代理商： | MC908QT1VDW |
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Input/Output Registers
MC68HC908QY/QT Family Data Sheet, Rev. 5
Freescale Semiconductor
47
3.7.2 ADC Data Register
One 8-bit result register is provided. This register is updated each time an ADC conversion completes.
3.7.3 ADC Input Clock Register
This register selects the clock frequency for the ADC.
ADIV2–ADIV0 — ADC Clock Prescaler Bits
ADIV2, ADIV1, and ADIV0 form a 3-bit field which selects the divide ratio used by the ADC to generate
the internal ADC clock. Table 3-2 shows the available clock configurations. The ADC clock frequency
should be set between fADIC(MIN) and fADIC(MAX). The analog input level should remain stable for the
entire conversion time (maximum = 17 ADC clock cycles).
Address: $003E
Bit 7
654321
Bit 0
Read:
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
Write:
Reset:
Indeterminate after reset
= Unimplemented
Figure 3-4. ADC Data Register (ADR)
Address: $003F
Bit 7
654321
Bit 0
Read:
ADIV2
ADIV1
ADIV0
00000
Write:
Reset:
00000000
= Unimplemented
Figure 3-5. ADC Input Clock Register (ADICLK)
Table 3-2. ADC Clock Divide Ratio
ADIV2
ADIV1
ADIV0
ADC Clock Rate
0
Bus clock ÷ 1
0
1
Bus clock ÷ 2
0
1
0
Bus clock ÷ 4
0
1
Bus clock ÷ 8
1
X
Bus clock ÷ 16
X = don’t care
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC908QY1MDT | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16 |
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| MC908QT2CDWR2 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO8 |
| MC908QT1VFQ | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, DSO8 |
| MC908QY2CDTR2 | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MC908QT1VPE | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:M68HC08 Microcontrollers |
| MC908QT2 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MC908QT2 |
| MC908QT2A | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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