參數(shù)資料
型號(hào)： MC908GR48ACFUE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 34/314頁(yè)
文件大?。?/td> 0K
描述： IC MCU 48K FLASH 8MHZ 64-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI，SPI
外圍設(shè)備： LVD，POR，PWM
輸入/輸出數(shù)： 53
程序存儲(chǔ)器容量： 48KB（48K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1.5K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 24x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-QFP
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 726 (CN2011-ZH PDF)
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LVI Status Register
MC68HC908GR60A MC68HC908GR48A MC68HC908GR32A Data Sheet, Rev. 5
Freescale Semiconductor
129
11.3.3 Voltage Hysteresis Protection
Once the LVI has triggered (by having VDD fall below VTRIPF), the LVI will maintain a reset condition until
VDD rises above the rising trip point voltage, VTRIPR. This prevents a condition in which the MCU is
continually entering and exiting reset if VDD is approximately equal to VTRIPF. VTRIPR is greater than
VTRIPF by the hysteresis voltage, VHYS.
11.3.4 LVI Trip Selection
The LVI5OR3 bit in the configuration register selects whether the LVI is configured for 5-V or 3-V
protection.
NOTE
The microcontroller is guaranteed to operate at a minimum supply voltage.
The trip point (VTRIPF [5 V] or VTRIPF [3 V]) may be lower than this. See
Chapter 20 Electrical Specifications for the actual trip point voltages.
11.4 LVI Status Register
The LVI status register (LVISR) indicates if the VDD voltage was detected below the VTRIPF level.
LVIOUT — LVI Output Bit
This read-only flag becomes set when the VDD voltage falls below the VTRIPF trip voltage (see
Table 11-1). Reset clears the LVIOUT bit.
11.5 LVI Interrupts
The LVI module does not generate interrupt requests.
Address:
$FE0C
Bit 7
654321
Bit 0
Read:
LVIOUT
0000000
Write:
Reset:
00000000
= Unimplemented
Figure 11-3. LVI Status Register (LVISR)
Table 11-1. LVIOUT Bit Indication
VDD
LVIOUT
VDD > VTRIPR
0
VDD < VTRIPF
1
VTRIPF < VDD < VTRIPR
Previous value
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PDF描述
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