參數(shù)資料
型號： MC68S711PH8CPV4
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, MICROCONTROLLER, PQFP112
封裝： TQFP-112
文件頁數(shù)： 224/264頁
文件大?。?/td> 1484K
代理商： MC68S711PH8CPV4
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08/Apr/97@13:55 [DS97 v 4.1]
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PH8.DS03/Modes+mem
MOTOROLA
3-16
MC68HC11PH8
OPERATING MODES AND ON-CHIP MEMORY
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
3.3.2.3
INIT2 — EEPROM mapping and MI BUS delay register
This register determines the location of EEPROM in the memory map and controls stretching of
external accesses. INIT2 may be read at any time but bits 7–4 may be written only once after reset
in normal modes (bits 3, 1 and 0 may be written at any time).
EE[3:0] — EEPROM map position
EEPROM is located at $xD00–$xFFF, where x is the hexadecimal digit represented by EE[3:0].
Refer to Table 3-6.
STRX — Stretch extended
1 (set)
–
All external accesses are extended by one E clock cycle.
0 (clear) –
Only external access from $0000 to $1FFF (ROMAD set) or from
$C000 to $DFFF (ROMAD clear) are extended by one E clock cycle.
This bit only has meaning in expanded mode, and only if the STRCH bit in OPT2 is set (see
Bit 2 — Not implemented; always reads zero.
M2DL1, M2DL0 — MI BUS delay select (refer to Section 6)
This bit is not present on early versions of the MC68HC711PH8. On those devices, bit 3 is not
implemented and always reads zero, and the stretch function is controlled solely by the
STRCH bit in OPT2 (see Section 3.3.2.5). Contact your local Motorola Sales Representative
for further information.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
EEPROM mapping (INIT2)
$0037
EE3
EE2
EE1
EE0
STRX
0
M2DL1 M2DL0 0000 0000
Table 3-6 EEPROM remapping
EE[3:0]
Location
EE[3:0]
Location
0000
$0D00$0FFF
1000
$8D00$8FFF
0001
$1D00$1FFF
1001
$9D00$9FFF
0010
$2D00$2FFF
1010
$AD00$AFFF
0011
$3D00$3FFF
1011
$BD00$BFFF
0100
$4D00$4FFF
1100
$CD00$CFFF
0101
$5D00$5FFF
1101
$DD00$DFFF
0110
$6D00$6FFF
1110
$ED00$EFFF
0111
$7D00$7FFF
1111
$FD00$FFFF
TPG
60
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PDF描述
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