參數(shù)資料
型號(hào)： MC68S11PH8CFN3
廠(chǎng)商： MOTOROLA INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 8-BIT, MROM, MICROCONTROLLER, PQCC84
封裝： PLASTIC, LCC-84
文件頁(yè)數(shù)： 97/264頁(yè)
文件大?。?/td> 1484K
代理商： MC68S11PH8CFN3
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MOTOROLA
10-2
MC68HC11PH8
RESETS AND INTERRUPTS
10
10.1.2
External reset (RESET)
The CPU distinguishes between internal and external reset conditions by sensing whether the
reset pin rises to a logic one in less than four E clock cycles after an internal device releases reset.
When a reset condition is sensed, the RESET pin is driven low by an internal device for eight E
clock cycles, then released. Four E clock cycles later it is sampled. If the pin is still held low, the
CPU assumes that an external reset has occurred. If the pin is high, it indicates that the reset was
initiated internally by either the COP system or the clock monitor. It is not advisable to connect an
external resistor capacitor (RC) power-up delay circuit to the reset pin of M68HC11 devices
because the circuit charge time constant can cause the device to misinterpret the type of reset
that occurred. To guarantee recognition of an external reset, the RESET pin should be held low
for at least 16 clock cycles.
10.1.3
COP reset
The MCU includes a COP system to help protect against software failures. When the COP is
enabled, the software is responsible for keeping a free-running watchdog timer from timing out.
When the software is no longer being executed in the intended sequence, a system reset is
initiated.
The state of the NOCOP bit in the CONFIG register determines whether the COP system is
enabled or disabled. To change the enable status of the COP system, change the contents of the
CONFIG register and then perform a system reset. In the special test and bootstrap operating
modes, the COP system is initially inhibited by the disable resets (DISR) control bit in the TEST1
register. The DISR bit can subsequently be written to zero to enable COP resets.
The COP function has two possible clock sources. When PLL clock generation is not used
(VDDSYN = 0), the clocking chain for the COP function is tapped off from the main timer divider
chain (E/215); refer to Figure 8-1. When the PLL clock generation is used (VDDSYN = 1), the COP
function can be clocked by the underow of the 8-bit modulus timer A (CLK64/4); see Figure 8-2.
The COP timer rate control bits CR[1:0] in the OPTION register determine the COP timeout
period. The COP clock source frequency is scaled by the factor shown in Table 10-1 or Table 10-2.
After reset, bits CR[1:0] are zero, which selects the shortest timeout period. In normal operating
modes, these bits can only be written once, within 64 bus cycles after reset.
TPG
184
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PDF描述
MC68S711PH8CPV3 8-BIT, OTPROM, MICROCONTROLLER, PQFP112
MC68HC11PH8CPV3 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQFP112
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MC68S711E9CFNE2 功能描述:8位微控制器 -MCU 8B MCU 512 RAM EPP RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線(xiàn)寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
MC68SEC000AA10 功能描述:微處理器 - MPU 8/16/32 BIT MPU STATIC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線(xiàn)寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類(lèi)型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68SEC000AA10R2 功能描述:IC MPU 32BIT 10MHZ 64-QFP RoHS:是 類(lèi)別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M680x0 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類(lèi)型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類(lèi)型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤(pán)
MC68SEC000AA16 功能描述:微處理器 - MPU 8/16/32 BIT MPU STATIC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線(xiàn)寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類(lèi)型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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