參數(shù)資料
型號(hào)： MC68MH360RC33
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： QUad Integrated Communications Controller Users Manual
中文描述： 32-BIT, 33 MHz, RISC MICROCONTROLLER, CPGA241
封裝： PGA-241
文件頁數(shù)： 590/962頁
文件大?。?/td> 2817K
代理商： MC68MH360RC33
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Serial Communication Controllers (SCCs)
7-266
MC68360 USER’S MANUAL
MOTOROLA
7.10.23.23 SCC ETHERNET EXAMPLE.
The following list is an initialization sequence for
an Ethernet channel. SCC1 is used. The CLK1 pin is used for the Ethernet receiver, and the
CLK2 pin is used for the Ethernet transmitter.
1. The SDCR (SDMA Configuration Register) should be initialized to $0740, rather than
being left at its default value of $0000.
2. Configure the port A pins to enable the TXD1 and RXD1 pins. Write PAPAR bits 0
and 1 with ones. Write PADIR bits 0 and 1 with zeros. Write PAODR bit 1 with
zero.
3. Configure the port C pins to enable CTS1 (CLSN) and CD1 (RENA). Write
PCPAR bits 4 and 5 with zeros. Write PCDIR bits 4 and 5 with zero. Write PCSO
bits 4 and 5 with ones.
4. Do not enable the RTS1 (TENA) pin yet because the pin is still functioning as RTS
(inactive in the high state), and transmission on the LAN could accidentally begin.
5. Configure port A to enable the CLK1 and CLK2 pins. Write PAPAR bits 8 and 9
with a ones. Write PADIR bits 8 and 9 with zeros.
6. Connect the CLK1 and CLK2 pins to SCC1 using the SI. Write the R1CS bits in
SICR to 101. Write the T1CS bits in SICR to 100.
7. Connect the SCC1 to the NMSI (i.e., its own set of pins). Clear the SC1
bit in the SICR.
8. Write RBASE and TBASE in the SCC parameter RAM to point to the Rx BD and
Tx BD in the dual-port RAM. Assuming one Rx BD at the beginning of dual-port
RAM, and one Tx BD following that Rx BD, write RBASE with $0000 and TBASE
with $0008.
9. Program the CR to execute the INIT RX & TX PARAMS command for this channel.
For instance, to execute this command for SCC1, write $0001 to the CR. This com-
mand causes the RBPTR and TBPTR parameters of the serial channel to be updated
with the new values just programmed into RBASE and TBASE.
10.Write RFCR with $18 and TFCR with $18 for normal operation.
11.Write MRBLR with the maximum number of bytes per receive buffer. For this case,
assume 1520 bytes, so MRBLR = $05F0. (In this example, the user wants to
receive an entire frame into one buffer, so the MRBLR value is simply chosen to be
the first value larger than 1518 that is evenly divisible by 4).
12.Write C_PRES with $FFFFFFFF to comply with 32-bit CCITT-CRC.
13.Write C_MASK with $DEBB20E3 to comply with 32-bit CCITT-CRC.
14.Clear CRCEC, ALEC, and DISFC for the sake of clarity.
15.Write PAD with $8888 for the PAD value.
16.Write RET_Lim with $000F.
17.Write MFLR with $05EE to make the maximum frame size 1518 bytes.
18.Write MINFLR with $0040 to make the minimum frame size 64 bytes.
19.Write MAXD1 and MAXD2 with $05EE to make the maximum DMA count 1518
bytes.
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