參數資料
型號： MC68HRC705KJ1CDW
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDSO16
封裝： SOIC-16
文件頁數： 86/117頁
文件大?。?/td> 1644K
代理商： MC68HRC705KJ1CDW
Parallel I/O Ports (PORTS)
Data Sheet
MC68HC705KJ1MC68HRC705KJ1MC68HLC705KJ1 — Rev. 4.0
70
Parallel I/O Ports (PORTS)
MOTOROLA
DDRB[3:2] — Data Direction Register B Bits
These read/write bits control port B data direction. Reset clears DDRB[3:2],
configuring all port B pins as inputs.
1 = Corresponding port B pin configured as output
0 = Corresponding port B pin configured as input
NOTE:
Avoid glitches on port B pins by writing to the port B data register before changing
data direction register B bits from 0 to 1.
Figure 7-8 shows the I/O logic of port B.
Figure 7-8. Port B I/O Circuitry
Writing a logic 1 to a DDRB bit enables the output buffer for the corresponding port
B pin; a logic 0 disables the output buffer.
When bit DDRBx is a logic 1, reading address $0001 reads the PBx data latch.
When bit DDRBx is a logic 0, reading address $0001 reads the voltage level on the
pin. The data latch can always be written, regardless of the state of its data
direction bit. Table 7-2 summarizes the operation of the port B pins.
Table 7-2. Port B Pin Operation
Data Direction Bit
I/O Pin Mode
Accesses to Data Bit
Read
Write
0
Input, high-impedance
Pin
Latch(1)
1. Writing affects the data register, but does not affect input.
1
Output
Latch
READ DDRB
WRITE DDRB
RESET
WRITE PORTB
READ PORTB
PBx
INTERN
AL
D
AT
A
B
U
S
DDRBx
PBx
PDRBx
SWPDI
100-
A
PULLDOWN
WRITE PDRB
相關PDF資料
PDF描述
MC68HRC705KJ1CS 8-BIT, UVPROM, 4 MHz, MICROCONTROLLER, CDIP16
MC68HRC705KJ1CP 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDIP16
MC68HLC705KJ1CDW 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDSO16
MC68HC705KJ1CP 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDIP16
MC68HLC705KJ1CP 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PDIP16
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