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參數(shù)資料
| 型號： | MC68HLC908QY2CDT |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | TSSOP-16 |
| 文件頁數(shù)： | 178/186頁 |
| 文件大?。?/td> | 2583K |
| 代理商： | MC68HLC908QY2CDT |
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Low-Voltage Inhibit (LVI)
LVI Status Register
MC68HLC908QY/QT Family — Rev. 2
Data Sheet
MOTOROLA
Low-Voltage Inhibit (LVI)
91
10.3.4 LVI Trip Selection
The LVDLVR bit in the configuration register selects whether the LVI is configured
for LVD (low voltage detect) or LVR (low voltage reset) protection. The LVD trip
voltage can be used as a low voltage warning. The LVR trip voltage will commonly
be configured as a reset condition since it is very close to the minimum operating
voltage of the device. The LVDLVR bit can be written to anytime so that battery
applications can make use of the LVI as both a warning indicator and to generate
a system reset.
Polling and forced reset operation modes can be combined to take full advantage
of LVD and LVR trip voltages selection. LVD (LVDLVR = 1) in polling mode
(LVIRSTD = 1) can be used as a low voltage warning in a slowly and continuously
falling VDD application (for example, battery applications). Once LVD has been
identified, the part can be set to LVR (LVDLVR = 0) and reset enabled
(LVIRSTD = 0). So, as VDD continues to fall the part will reset when LVR trip
voltage is reached. Unlike other bits in CONFIG registers, LVIRSTD and LVDLVR
bits are allowed to be written multiple times after reset.
NOTE:
The microcontroller is guaranteed to operate at a minimum supply voltage. The trip
Electrical Characteristics for the actual trip point voltages.
10.4 LVI Status Register
The LVI status register (LVISR) indicates if the VDD voltage was detected below
the VTRIPF level while LVI resets have been disabled.
LVIOUT — LVI Output Bit
This read-only flag becomes set when the VDD voltage falls below the VTRIPF
trip voltage and is cleared when VDD voltage rises above VTRIPR. The difference
in these threshold levels results in a hysteresis that prevents oscillation into and
out of reset (see Table 10-1). Reset clears the LVIOUT bit.
Address: $FE0C
Bit 7
6
54
32
1
Bit 0
Read:
LVIOUT
0
00
0
R
Write:
Reset:
000
00
0
= Unimplemented
R
= Reserved
Figure 10-2. LVI Status Register (LVISR)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HLC908QY2CP | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP16 |
| MC68HLC908QT4P | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP8 |
| MC68HLC908QT2P | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP8 |
| MC68HLC908QT2FQ | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PQCC8 |
| MC68HLC908QT1DW | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO8 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MC68HLC908QY2CP | 制造商:Rochester Electronics LLC 功能描述:LOW V-1.5K FLASH W/ADC - Bulk |
| MC68HLC908QY2DW | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| MC68HLC908QY4CDW | 制造商:Rochester Electronics LLC 功能描述: 制造商:Freescale Semiconductor 功能描述: |
| MC68HLC908QY4CP | 制造商:Rochester Electronics LLC 功能描述:LOW V-4K FLASH W/ADC - Bulk |
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