參數(shù)資料
型號: MC68HLC908QT1DW
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO8
封裝: SOIC-8
文件頁數(shù): 8/186頁
文件大小: 2765K
代理商: MC68HLC908QT1DW
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Input/Output Ports (PORTS)
Port A
MC68HLC908QY/QT Family — Rev. 2
Data Sheet
MOTOROLA
Input/Output Ports (PORTS)
105
12.2.2 Data Direction Register A
Data direction register A (DDRA) determines whether each port A pin is an input or
an output. Writing a 1 to a DDRA bit enables the output buffer for the corresponding
port A pin; a 0 disables the output buffer.
DDRA[5:0] — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears DDRA[5:0],
configuring all port A pins as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE:
Avoid glitches on port A pins by writing to the port A data register before changing
data direction register A bits from 0 to 1.
Figure 12-4 shows the port A I/O logic.
Figure 12-4. Port A I/O Circuit
NOTE:
Figure 12-4 does not apply to PTA2
When DDRAx is a 1, reading address $0000 reads the PTAx data latch. When
DDRAx is a 0, reading address $0000 reads the voltage level on the pin. The data
latch can always be written, regardless of the state of its data direction bit.
Address: $0004
Bit 7
6
54
32
1
Bit 0
Read:
R
DDRA5
DDRA4
DDRA3
0
DDRA1
DDRA0
Write:
Reset:
000
00
000
R
= Reserved
= Unimplemented
Figure 12-3. Data Direction Register A (DDRA)
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
PTAx
DDRAx
PTAx
INTE
RNAL
D
AT
A
B
U
S
30 k
PTAPUEx
TO KEYBOARD INTERRUPT CIRCUIT
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關PDF資料
PDF描述
MC68HLC908QY1CDT 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16
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MC68HLC908QT1CDW 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO8
MC68HLC98JL3EIP 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP28
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