參數(shù)資料
型號: MC68HLC908QT1DW
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO8
封裝: SOIC-8
文件頁數(shù): 11/186頁
文件大小: 2583K
代理商: MC68HLC908QT1DW
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Input/Output Ports (PORTS)
Data Sheet
MC68HLC908QY/QT Family — Rev. 2
108
Input/Output Ports (PORTS)
MOTOROLA
Figure 12-8. Port B I/O Circuit
When DDRBx is a 1, reading address $0001 reads the PTBx data latch. When
DDRBx is a 0, reading address $0001 reads the voltage level on the pin. The
data latch can always be written, regardless of the state of its data direction bit.
Table 12-2 summarizes the operation of the port B pins.
12.3.3 Port B Input Pullup Enable Register
The port B input pullup enable register (PTBPUE) contains a software configurable
pullup device for each of the eight port B pins. Each bit is individually configurable
and requires the corresponding data direction register, DDRBx, be configured as
input. Each pullup device is automatically and dynamically disabled when its
corresponding DDRBx bit is configured as output.
Table 12-2. Port B Pin Functions
DDRB
Bit
PTB
Bit
I/O Pin
Mode
Accesses to DDRB
Accesses to PTB
Read/Write
Read
Write
0
X(1)
1. X = don’t care
Input, Hi-Z(2)
2. Hi-Z = high impedance
DDRB7–DDRB0
Pin
PTB7–PTB0(3)
3. Writing affects data register, but does not affect the input.
1
X
Output
DDRB7–DDRB0
Pin
PTB7–PTB0
READ DDRB ($0005)
WRITE DDRB ($0005)
RESET
WRITE PTB ($0001)
READ PTB ($0001)
PTBx
DDRBx
PTBx
INT
E
RNAL
D
AT
A
BUS
30 k
PTBPUEx
Address: $000C
Bit 7
6543
21
Bit 0
Read:
PTBPUE7
PTBPUE6
PTBPUE5
PTBPUE4
PTBPUE3
PTBPUE2
PTBPUE0
Write:
Reset:
00000
00
0
Figure 12-9. Port B Input Pullup Enable Register (PTBPUE)
相關PDF資料
PDF描述
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