參數(shù)資料
型號: MC68HC908QT1MDW
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO8
封裝: SOIC-8
文件頁數(shù): 33/192頁
文件大?。?/td> 3292K
代理商: MC68HC908QT1MDW
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System Integration Module (SIM)
Data Sheet
MC68HC908QY/QT Family — Rev. 3
128
System Integration Module (SIM)
MOTOROLA
Figure 13-17. Wait Recovery from Internal Reset
13.7.2 Stop Mode
In stop mode, the SIM counter is reset and the system clocks are disabled. An
interrupt request from a module can cause an exit from stop mode. Stacking for
interrupts begins after the selected stop recovery time has elapsed. Reset or break
also causes an exit from stop mode.
The SIM disables the oscillator signals (BUSCLKX2 and BUSCLKX4) in stop
mode, stopping the CPU and peripherals. Stop recovery time is selectable using
the SSREC bit in the configuration register 1 (CONFIG1). If SSREC is set, stop
recovery is reduced from the normal delay of 4096 BUSCLKX4 cycles down to 32.
This is ideal for the internal oscillator, RC oscillator, and external oscillator options
which do not require long start-up times from stop mode.
NOTE:
External crystal applications should use the full stop recovery time by clearing the
SSREC bit.
The SIM counter is held in reset from the execution of the STOP instruction until
the beginning of stop recovery. It is then used to time the recovery period.
Figure 13-18 shows stop mode entry timing and Figure 13-19 shows the stop
mode recovery time from interrupt or break.
NOTE:
To minimize stop current, all pins configured as inputs should be driven to a logic 1
or logic 0.
Figure 13-18. Stop Mode Entry Timing
ADDRESS BUS
DATA BUS
RST
$A6
$6E0B
RSTVCTH
RSTVCTL
$A6
BUSCLKX4
32
CYCLES
32
CYCLES
STOP ADDR + 1
SAME
ADDRESS BUS
DATA BUS
PREVIOUS DATA
NEXT OPCODE
SAME
STOP ADDR
SAME
R/W
CPUSTOP
NOTE: Previous data can be operand data or the STOP opcode, depending on the last instruction.
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