參數(shù)資料
型號: MC68HC908QL4CP
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDIP16
封裝: PLASTIC DIP-16
文件頁數(shù): 88/244頁
文件大?。?/td> 3228K
代理商: MC68HC908QL4CP
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Slave LIN Interface Controller (SLIC)
Data Sheet
MC68HC908QL Family
178
Slave LIN Interface Controller (SLIC)
MOTOROLA
14.18 Byte Transfer Mode Operation
This subsection describes the operation and limitations of the optional UART-like
byte transfer mode (BTM). This mode allows sending and receiving individual
bytes, but changes the behavior of the SLCBT registers (now read/write registers)
and locks the SLCDLC to 1 byte data length. The SLCBT value now becomes the
bit time reference for the SLIC, where the software sets the length of one bit time
rather than the SLIC module itself. This is similar to an input capture/output
compare (IC/OC) count in a timer module, where the count value represents the
number of SLIC clock counts in one bit time.
Byte transfer mode assumes that the user has a very stable, precise oscillator,
resonator, or clock reference input into the MCU and is therefore not appropriate
for use with internal oscillators. There is no synchronization method available to the
user in this mode and the user must tell the SLIC how many clock counts comprise
calculations to determine the SLCBT value for different settings.
In the example in Figure 14-25, the user should write 0x16, as a write of 0x15
(decimal value of 21) would automatically revert to 0x14, resulting in transmitted bit
times that are 1.33 SLIC clock periods too short rather than 0.667 SLIC clock
periods too long. The optimal choice, which gives the smallest resolution error, is
the closest even number of SLIC clocks to the exact calculated SLCBT value.
There is a trade-off between maximum bit rate and resolution with the SLIC in BTM
mode. Faster SLIC clock speeds improve resolution, but require higher numbers to
be written to the SLCBT registers for a given desired bit rate. It is up to the user to
determine what level of resolution is acceptable for the given application.
Table 14-7. Maximum LIN Bit Rates for High-Speed Operation Due to Digital Receive Filter
SLIC
Clock
(MHz)
Maximum LIN
Bit Rate for ±1.5%
SLIC Accuracy
(for Master-Slave
Communication
(Bits / Second)
DIGITAL RX FILTER
NOT CONSIDERED
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷4
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷3
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷2
(Bits / Second)
Maximum LIN
Bit Rate with
Digital RX Filter
Set to
÷1
(Bits / Second)
THESE PRESCALERS
NOT RECOMMENDED FOR
HIGH-SPEED LIN OPERATION
8
120,000
125,000
166,667
250,000
500,000
6.4
96,000
100,000
133,333
200,000
400,000
4.8
72,000
75,000
100,000
150,000
300,000
4
60,000
62,500
83,333
125,000
250,000
3.2
48,000
50,000
66,667
100,000
200,000
2.4
36,000
37,500
50,000
75,000
150,000
2
30,000
31,250
41,667
62,500
125,000
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PDF描述
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參數(shù)描述
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