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參數(shù)資料
| 型號： | MC68HC908QL2MDT |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| 封裝： | TSSOP-16 |
| 文件頁數(shù)： | 59/244頁 |
| 文件大?。?/td> | 3228K |
| 代理商： | MC68HC908QL2MDT |
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Slave LIN Interface Controller (SLIC)
SLIC Registers and Control Bits
MC68HC908QL Family
Data Sheet
MOTOROLA
Slave LIN Interface Controller (SLIC)
151
The frequency of the SLIC clock must be between 2 MHz and 8 MHz, factoring in
worst case possible numbers due to untrimmed process variations, as well as
temperature and voltage variations in oscillator frequency. This will guarantee
greater than 1.5% accuracy for all LIN messages from 1–20 kbps. The faster this
input clock is, the greater the resulting accuracy and the higher the possible bit
rates at which the SLIC can send and receive. In LIN systems, the bit rates will not
exceed 20 kbps; however, the SLIC module is capable of much higher speeds
without any configuration changes, for cases such as high-speed downloads for
reprogramming of FLASH memory or diagnostics in a test environment where
radiated emissions requirements are not as stringent. In these situations, the user
may choose to run faster than the 20 kbps limit which is imposed by the LIN
specification for EMC reasons. Details of how to calculate maximum bit rates and
operate the SLIC above 20 kbps are detailed in 14.17 High-Speed LIN Operation.
Refer to 14.9 SLIC Module Initialization Procedure for more information on when
to set up this register.
14.6.5 SLIC Bit Time Registers
NOTE:
In this subsection, the SLIC bit time registers are collectively referred to as SLCBT.
In LIN operating mode (BTM = 0), the SLCBT is updated by the SLIC upon
reception of a LIN break-synch combination and provides the number of SLIC
clock counts that equal one LIN bit time to the user software. This value can be
used by the software to calculate the clock drift in the oscillator as an offset to a
known count value (based on nominal oscillator frequency and LIN bus speed).
The user software can then trim the oscillator to compensate for clock drift. Refer
to 14.19 Oscillator Trimming with SLIC for more information on this procedure.
The user cannot read the bit time value from SLCBTH and SLCBTL any time after
the identifier byte is received until the beginning of the next LIN message frame on
the bus. The beginning of this message frame activity will be indicated by the
SLCACT bit.
When in byte transfer mode (BTM = 1), the SLCBT must be written by the user to
set the length of one bit at the desired bit rate in SLIC clock counts. The user
software must initialize this number prior to sending or receiving data, based on the
input clock selection, prescaler stage choice, and desired bit rate. This setting is
similar to choosing an input capture or output compare value for a timer. The
closest even value should be chosen for this value, as BT0 will be forced to 0 by
the SLIC module and any odd value will always be reduced to the next lowest even
integer value. For example, a write of value 51 (0x33) will be forced to value of 50
and read back as 0x32. A write to both registers is required to update the bit time
value.
NOTE:
The SLIC bit time will not be updated until a write of the SLCBTL has occurred.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC908QL3VDT | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| MC68HC908QL4MDT | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| MC68HC908QL2MDW | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
| MC68HC908QL4VDT | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDSO16 |
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參數(shù)描述 |
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