參數(shù)資料
型號： MC68HC908MR32CFU
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PQFP64
封裝： PLASTIC, QFP-64
文件頁數(shù)： 177/282頁
文件大?。?/td> 1877K
代理商： MC68HC908MR32CFU
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MC6
8
HC9
08MR32
MC6
8
HC90
8
MR16
Da
ta
Sheet,
Re
v
.6
.1
258
Fre
e
scale
Semico
nductor
Devel
opment
Su
ppo
rt
Table 18-2. Monitor Mode Signal Requirements and Options
IRQ
RESET
(S1)
$FFFE
/$FFFF
PLL
PTC3 PTC4
PTC2
(S2)
External
Clock(1)
1. External clock is derived by a 32.768 kHz crystal or a 4.9152/9.8304 MHz off-chip oscillator.
CGMOUT
Bus
Frequency
COP
For Serial
Communication(2)
2. DNA = does not apply, X = don’t care
Comment
PTA0
PTA7
(S3)
Baud
Rate(3) (4)
3. PAT0 = 1 if serial communication; PTA0 = X if parallel communication
4. PTA7 = 0
→ serial, PTA7 = 1 → parallel communication for security code entry
X
GND
X
0
Disabled
X
0
No operation until reset goes high
VTST
VDD
or
VTST
X
OFF
100
4.9152
MHz
4.9152
MHz
2.4576
MHz
Disabled
1
0
9600
PTC3 and PTC2 voltages only required if
IRQ = VTST; PTC2 determines frequency
divider
X
1
DNA
VTST
VDD
or
VTST
X
OFF
101
9.8304
MHz
4.9152
MHz
2.4576
MHz
Disabled
1
0
9600
PTC3 and PTC2 voltages only required if
IRQ = VTST; PTC2 determines frequency
divider
X
1
DNA
VDD
$FFFF
Blank
OFF
X
9.8304
MHz
4.9152
MHz
2.4576
MHz
Disabled
1
0
9600
External frequency always divided by 4
X
1
DNA
VDD
or
GND
VTST
$FFFF
Blank
OFF
X
XX
X
—
Enabled
XX
—
Enters user mode — will encounter an
illegal address reset
VDD
or
GND
VDD
or
VTST
Non-$FF
Programmed
OFF
X
—
Enabled
X
—
Enters user mode
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PDF描述
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