參數資料
型號： MC68HC908MR32CB
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8.2 MHz, MICROCONTROLLER, PDIP56
封裝： SHRINK, DIP-56
文件頁數： 242/282頁
文件大小： 1877K
代理商： MC68HC908MR32CB
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Clock Generator Module (CGM)
MC68HC908MR32 MC68HC908MR16 Data Sheet, Rev. 6.1
62
Freescale Semiconductor
5.
Calculate the bus frequency, fBUS, and compare fBUS with fBUSDES.
6.
If the calculated fBUS is not within the tolerance limits of the application, select another fBUSDES or
another fRCLK.
7.
Using the value 4.9152 MHz for fNOM, calculate the VCO linear range multiplier, L. The linear range
multiplier controls the frequency range of the PLL.
8.
Calculate the VCO center-of-range frequency, fVRS. The center-or-range frequency is the midpoint
between the minimum and maximum frequencies attainable by the PLL.
fVRS = L x fNOM
Example: fVRS = 7 x 4.9152 MHz = 34.4 MHz
For proper operation,
CAUTION
Exceeding the recommended maximum bus frequency or VCO frequency can crash the MCU.
9.
Program the PLL registers accordingly:
a.
In the upper four bits of the PLL programming register (PPG), program the binary equivalent
of N.
b.
In the lower four bits of the PLL programming register (PPG), program the binary equivalent
of L.
4.3.2.5 Special Programming Exceptions
The programming method described in 4.3.2.4 Programming the PLL does not account for possible
exceptions. A value of 0 for N or L is meaningless when used in the equations given. To account for these
exceptions:
A 0 value for N is interpreted exactly the same as a value of 1.
A 0 value for L disables the PLL and prevents its selection as the source for the base clock. See
4.3.3 Base Clock Selector Circuit
This circuit is used to select either the crystal clock, CGMXCLK, or the VCO clock, CGMVCLK, as the
source of the base clock, CGMOUT. The two input clocks go through a transition control circuit that waits
up to three CGMXCLK cycles and three CGMVCLK cycles to change from one clock source to the other.
During this time, CGMOUT is held in stasis. The output of the transition control circuit is then divided by
fBUS =
fVCLK
4
Example: N =
32 MHz
4 MHz
= 8 MHz
Example: L =
32 MHz
4.9152 MHz
= 7 MHz
L = round
fVCLK
fNOM
(
)
fVRS – fVCLK | ≤
fNOM
2
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