參數(shù)資料
型號： MC68HC908LB8_05
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： M68HC08 Microcontrollers
中文描述： M68HC08系列微控制器
文件頁數(shù)： 107/234頁
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代理商： MC68HC908LB8_05
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HRP Registers
MC68HC908LB8 Data Sheet, Rev. 1
Freescale Semiconductor
107
DC[10:0] — 11-Bit Duty Cycle Value
STEP[4:0] — 5-Bit Dithering Step Value
10.8.3 HRP Period Registers
The two read/write period registers contain the 16-bit period of the PWM output after dithering. It is split
into two parts:
1.
11-bit period value (P[10:0]) used to generate the HRP’s output waveforms.
2.
5-bit step value (STEP[4:0]) the lower five bits of HRPPERH:HRPPERL, specifies how much time
is spent on the longer period (PERIOD2).
The output period including dithering in variable frequency mode is:
(EQ 10-12)
where 2
SEL[2:0]
is the STEP[4:0] scaling factor.
The output period in variable duty cycle mode does not include dithering. The period value is:
(EQ 10-13)
Writes to the high byte (HRPPERH) are stored in a latch until the low byte (HRPPERL) is written. Both
registers are then updated simultaneously. This prevents glitches in the output period.
Address: HRPDCH — $0052
Bit 15
Read:
DC10
Write:
Reset:
Bit 7
Read:
DC2
Write:
Reset:
HRPDCL — $0053
13
14
12
11
10
9
Bit 8
DC9
DC8
DC7
DC6
DC5
DC4
DC3
0
0
6
0
5
0
4
0
3
0
2
0
1
0
Bit 0
DC1
DC0
STEP4
STEP3
STEP2
STEP1
STEP0
0
0
0
0
0
0
0
0
Figure 10-11. HRP Duty Cycle Registers (HRPDCH:HRPDCL)
Address: HRPPERH — $0054
Bit 15
Read:
P10
Write:
Reset:
Bit 7
HRPPERL — $0055
13
14
12
11
10
9
Bit 8
P9
P8
P7
P6
P5
P4
P3
0
0
6
0
5
0
4
0
3
0
2
0
1
0
Bit 0
Figure 10-12. HRP Period Registers (HRPPERH:HRPPERL)
Output Period (seconds)
HRPCLK
]
P 10:0
INT----------------------------
SEL[2:0]
2
SEL[2:0]
]
-----32
HRPCLK
￥
-------------------2
+
=
Period
HRPCLK
--P[10:0]
=
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PDF描述
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