參數(shù)資料
型號(hào)： MC68HC908KX8CP
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Microcontrollers
中文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP16
封裝： PLASTIC, DIP-16
文件頁數(shù)： 111/278頁
文件大?。?/td> 4699K
代理商： MC68HC908KX8CP
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MC68HC908GT16 MC68HC908GT8 Data Sheet, Rev. 3
Freescale Semiconductor
111
Chapter 10
Low-Voltage Inhibit (LVI)
10.1 Introduction
This section describes the low-voltage inhibit (LVI) module, which monitors the voltage on the V
DD
pin
and can force a reset when the V
DD
voltage falls below the LVI trip falling voltage, V
TRIPF
.
10.2 Features
Features of the LVI module include:
Programmable LVI reset
Selectable LVI trip voltage
Programmable stop mode operation
10.3 Functional Description
Figure 10-1
shows the structure of the LVI module. The LVI is enabled out of reset. The LVI module
contains a bandgap reference circuit and comparator. Clearing the LVI power disable bit, LVIPWRD,
enables the LVI to monitor V
DD
voltage. Clearing the LVI reset disable bit, LVIRSTD, enables the LVI
module to generate a reset when V
DD
falls below a voltage, V
TRIPF
. Setting the LVI enable in stop mode
bit, LVISTOP, enables the LVI to operate in stop mode. Setting the LVI 5-V or 3-V trip point bit, LVI5OR3,
enables the trip point voltage, V
TRIPF
, to be configured for 5-V operation. Clearing the LVI5OR3 bit
enables the trip point voltage, V
TRIPF
, to be configured for 3-V operation. The actual trip points are shown
in
Chapter 20 Electrical Specifications
.
NOTE
After a power-on reset (POR) the LVI’s default mode of operation is 3 V. If
a 5-V system is used, the user must set the LVI5OR3 bit to raise the trip
point to 5-V operation. Note that this must be done after every power-on
reset since the default will revert back to 3-V mode after each power-on
reset. If the V
DD
supply is below the 5-V mode trip voltage but above the
3-V mode trip voltage when POR is released, the part will operate because
V
TRIPF
defaults to 3-V mode after a POR. So, in a 5-V system care must be
taken to ensure that V
DD
is above the 5-V mode trip voltage after POR is
released.
If the user requires 5-V mode and sets the LVI5OR3 bit after a power-on
reset while the V
DD
supply is not above the V
TRIPR
for 5-V mode, the
microcontroller unit (MCU) will immediately go into reset. The LVI in this
case will hold the part in reset until either V
DD
goes above the rising 5-V trip
point, V
TRIPR
, which will release reset or V
DD
decreases to approximately 0
V which will re-trigger the power-on reset and reset the trip point to 3-V
operation.
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