參數(shù)資料
型號： MC68HC908JL16
廠商： 飛思卡爾半導體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 186/230頁
文件大?。?/td> 1358K
代理商： MC68HC908JL16
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Development Support
MC68HC908JL16 Data Sheet, Rev. 1.1
186
Freescale Semiconductor
16.3.2 Entering Monitor Mode
Table 16-1
shows the pin conditions for entering monitor mode. As specified in the table, monitor mode
may be entered after a POR.
Communication at 9600 baud will be established provided one of the following sets of conditions is met:
1.
If IRQ = V
TST
:
–
Clock on OSC1 is 4.9125MHz
–
PTB3 = low
2.
If IRQ = V
TST
:
–
Clock on OSC1 is 9.8304MHz
–
PTB3 = high
3.
If $FFFE and $FFFF are blank (contain $FF):
–
Clock on OSC1 is 9.8304MHz
–
IRQ = V
DD
If V
TST
is applied to IRQ and PTB3 is low upon monitor mode entry (
Table 16-1
condition set 1), the bus
frequency is a divide-by-two of the clock input to OSC1. If PTB3 is high with V
TST
applied to IRQ upon
monitor mode entry (
Table 16-1
condition set 2), the bus frequency is a divide-by-four of the clock input
to OSC1. Holding the PTB3 pin low when entering monitor mode causes a bypass of a divide-by-two
stage at the oscillator
only if V
TST
is applied to IRQ.
In this event, the OSCOUT frequency is equal to the
2OSCOUT frequency, and OSC1 input directly generates internal bus clocks. In this case, the OSC1
signal must have a 50% duty cycle at maximum bus frequency.
Entering monitor mode with V
TST
on IRQ, the COP is disabled as long as V
TST
is applied to either IRQ or
RST. (See
Chapter 4 System Integration Module (SIM)
for more information on modes of operation.)
If entering monitor mode without high voltage on IRQ and reset vector being blank ($FFFE and $FFFF)
(
Table 16-1
condition set 3, where applied voltage is V
DD
), then all port B pin requirements and conditions,
including the PTB3 frequency divisor selection, are not in effect. This is to reduce circuit requirements
when performing in-circuit programming.
Entering monitor mode with the reset vector being blank, the COP is always disabled regardless of the
state of IRQ or the RST.
Table 16-1. Monitor Mode Entry Requirements and Options
IRQ
$FFFE
and
$FFFF
P
P
P
P
OSC1 Clock
(1)
1. RC oscillator cannot be used for monitor mode; must use either external oscillator or XTAL oscillator circuit.
2. See
Table 17-4
for V
TST
voltage level requirements.
Bus Frequency
Comments
V
TST(2)
X
0
0
1
1
4.9152MHz
2.4576MHz
High voltage entry to monitor
mode.
9600 baud communication on
PTB0. COP disabled.
V
TST(1)
X
1
0
1
1
9.8304MHz
2.4576MHz
V
DD
BLANK
(contain
$FF)
X
X
X
1
9.8304MHz
2.4576MHz
Blank reset vector
(low-voltage) entry to monitor
mode.
9600 baud communication on
PTB0. COP disabled.
V
DD
NOT
BLANK
X
X
X
X
X
OSC1 ÷ 4
Enters User mode.
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