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參數(shù)資料
| 型號(hào)： | MC68HC908JB8JDW |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 3 MHz, MICROCONTROLLER, PDSO20 |
| 封裝： | SOIC-20 |
| 文件頁數(shù)： | 130/286頁 |
| 文件大?。?/td> | 1402K |
| 代理商： | MC68HC908JB8JDW |
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Input/Output Ports (I/O)
Port E
MC68HC908JB8MC68HC08JB8MC68HC08JT8 — Rev. 2.3
Technical Data
Freescale Semiconductor
Input/Output Ports (I/O)
215
12.7.2 Data Direction Register E
Data direction register E determines whether each port E pin is an input
or an output. Writing a logic 1 to a DDRE bit enables the output buffer for
the corresponding port E pin; a logic 0 disables the output buffer.
DDRE[4:0] — Data Direction Register E Bits
These read/write bits control port E data direction. Reset clears
DDRE[4:0], configuring all port E pins as inputs.
1 = Corresponding port E pin configured as output
0 = Corresponding port E pin configured as input
PTE4 and PTE3 pins are open-drain when configured as output.
NOTE:
Avoid glitches on port E pins by writing to the port E data register before
changing data direction register E bits from 0 to 1.
NOTE:
For those devices packaged in a 20-pin PDIP and 20-pin SOIC package,
PTE2 and PTE0 are not connected. DDRE2 and DDRE0 should be set
to a 1 to configure PTE2 and PTE0 as outputs.
Figure 12-16 shows the port E I/O circuit logic.
Address:
$0009
Bit 7
654321
Bit 0
Read:
0
DDRE4
DDRE3
DDRE2
DDRE1
DDRE0
Write:
Reset:
0000000
0
= Unimplemented
Figure 12-15. Data Direction Register E (DDRE)
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